[发明专利]半导体互连结构及其制作方法在审

专利信息
申请号: 201910263376.4 申请日: 2019-04-02
公开(公告)号: CN111769073A 公开(公告)日: 2020-10-13
发明(设计)人: 吴秉桓 申请(专利权)人: 长鑫存储技术有限公司
主分类号: H01L21/768 分类号: H01L21/768;H01L23/48
代理公司: 北京律智知识产权代理有限公司 11438 代理人: 袁礼君;阚梓瑄
地址: 230000 安徽省合肥市*** 国省代码: 安徽;34
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摘要:
搜索关键词: 半导体 互连 结构 及其 制作方法
【权利要求书】:

1.一种半导体互连结构制作方法,其特征在于,包括:

提供上表面为第一介质层的第一半导体结构,所述第一介质层包括第一导电结构;

于所述第一介质层上制作第二半导体结构,所述第二半导体结构的上表面包括第二介质层;

在所述第二介质层进行两次光刻制程,以制作底部露出所述第一导电结构的垂直通孔,以及位于所述第二介质层中与所述垂直通孔上表面相交的导线沟槽,其中,所述垂直通孔且经过所述第一介质层和所述第二半导体结构;

一次性填充导电材料于所述垂直通孔和所述导线沟槽,以形成连接所述第一导电结构的互连结构,所述互连结构包括位于所述第二介质层的第二导电结构和连通所述第一导电结构和所述第二导电结构的第三导电结构。

2.如权利要求1所述的半导体互连结构制作方法,其特征在于,所述在所述第二介质层进行两次光刻制程包括:

通过第一光刻制程在所述第二介质层上蚀刻所述导线沟槽;

通过第二光刻制程在所述导线沟槽的下表面蚀刻所述垂直通孔,使所述垂直通孔经过所述第二半导体结构和所述第一介质层,底部露出所述第一导电结构。

3.如权利要求1所述的半导体互连结构制作方法,其特征在于,所述在所述第二介质层进行两次光刻制程包括:

通过第一光刻制程在所述第二半导体结构和所述第一介质层中蚀刻所述垂直通孔,使所述垂直通孔的底部露出所述第一导电结构;

通过第二光刻制程在所述第二介质层上蚀刻所述导线沟槽。

4.如权利要求1所述的半导体互连结构制作方法,其特征在于,所述第一导电结构为焊盘,所述第二导电结构为导线。

5.如权利要求1所述的半导体互连结构制作方法,其特征在于,所述第一导电结构和所述第二导电结构均为导线。

6.一种半导体互连结构,其特征在于,包括:

第一半导体结构,上表面为第一介质层,所述第一介质层包括第一导电结构;

第二半导体结构,键合于所述第一介质层,上表面为第二介质层;

第二导电结构,位于所述第二介质层;

第三导电结构,经过所述第一介质层和所述第二半导体结构,下表面连接于所述第一导电结构,上表面连接于所述第二导电结构;

其中,所述第二导电结构和所述第三导电结构通过同一次导电材料填充制程形成。

7.如权利要求6所述的半导体互连结构,其特征在于,所述第二导电结构和所述第三导电结构的制作过程包括:

通过第一光刻制程在所述第二介质层上蚀刻导线沟槽;

通过第二光刻制程在所述导线沟槽的下表面蚀刻垂直通孔,使所述垂直通孔经过所述第二半导体结构和所述第一介质层,底部露出所述第一导电结构;

一次性填充导电材料至所述导线沟槽和所述垂直通孔,以一次性形成所述第二导电结构和所述第三导电结构。

8.如权利要求6所述的半导体互连结构,其特征在于,所述第二导电结构和所述第三导电结构的制作过程包括:

通过第一光刻制程在所述第二半导体结构和所述第一介质层中蚀刻垂直通孔,使所述垂直通孔的底部露出所述第一导电结构;

通过第二光刻制程在所述第二介质层上蚀刻导线沟槽;

一次性填充导电材料至所述导线沟槽和所述垂直通孔,以一次性形成所述第二导电结构和所述第三导电结构。

9.如权利要求7所述的半导体互连结构,其特征在于,所述垂直通孔与所述导线沟槽的连接处包括第一倒角和第二倒角。

10.如权利要求6所述的半导体互连结构,其特征在于,所述第一导电结构为焊盘,所述第二导电结构为导线。

11.如权利要求6所述的半导体互连结构,其特征在于,所述第一导电结构和所述第二导电结构均为导线。

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