[发明专利]一种数字加密装置及方法在审

专利信息
申请号: 201910290575.4 申请日: 2019-04-11
公开(公告)号: CN110113147A 公开(公告)日: 2019-08-09
发明(设计)人: 周晓光;刘志赟 申请(专利权)人: 深圳市致宸信息科技有限公司
主分类号: H04L9/06 分类号: H04L9/06
代理公司: 深圳中一联合知识产权代理有限公司 44414 代理人: 江欣
地址: 518000 广东省深圳市南山区*** 国省代码: 广东;44
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摘要:
搜索关键词: 中间数据信息 使能信号 流程控制模块 硬件加密模块 数字加密 数据解析模块 原始数据信息 反馈信息 发送 控制信息生成 数字加密算法 读取 数据包生成 发送结束 反馈信号 控制信息 硬件成本 减小 存储 指令 更新
【说明书】:

发明属于数字加密领域,公开了一种数字加密装置及方法,数据解析模块根据数据包生成控制信息和原始数据信息;流程控制模块根据控制信息生成k个使能信号;发送第1个使能信号,以使第1个硬件加密模块根据原始数据信息生成第1个中间数据信息和第1个反馈信息;并依次根据第i‑1个反馈信号发送第i个使能信号并根据硬件加密模块的个数依次对i的值进行更新,以使第i个硬件加密模块根据第i‑1个中间数据信息和第i个使能信号生成第i个中间数据信息并存储,且发送第i个反馈信息至流程控制模块;流程控制模块当i大于等于k时,发送结束指令以使数据解析模块读取第i个中间数据信息;在适应不同的数字加密算法并减小了硬件成本。

技术领域

本发明属于数字加密领域,尤其涉及一种数字加密装置及方法。

背景技术

数字加密算法是对信息进行保护的一种可靠的办法,它利用密码技术对信息进行加密,实现信息屏蔽,从而起到保护信息安全的作用。技术上可以通过软件和硬件两种方法实现。而硬件方法在速度上有着巨大的优势。

随着半导体器件的飞速发展,尤其是ASIC的大规模应用,单一的数字加密算法很容易被无限碰撞的方法破解,从而得到相应的hash值(有用信息)。为了获得更多的hash值,人们依靠CPU、GPU、FPGA,尤其ASIC芯片的方式来组成高性能计算服务器,针对特定的加密算法做优化以快速破解加密算法。当前的很多非主流的数字加密算法为了维持对于ASIC的抵抗性,它通过将多个算法整合在一起,通过某些规则将这些算法串起来。一旦发现有ASIC设备进行计算时,原创算法团队可以迅速小幅调整算法(增加算法数量,调整算法映射序号,增加异或运算等)以使得竞争对手的ASIC失效,迫使其ASIC设备报废。因为ASIC组成的高性能计算服务器虽然生产成本较低,计算速度比x86CPU/GPU要快得多,但是灵活度很低,只能针对特定的算法进行加速,一旦算法修改,既有投资将化为乌有,并且一般来说体积庞大,需要专门的电源和散热设备,不易携带。目前很多非主流的数字加密算法都是采用x86CPU或者GPU来进行高性能计算,虽然比较灵活,不受算法修改的影响,但是硬件成本较高。

故传统的数字加密装置存在无法在适应不同的算法的同时减小硬件成本的缺陷。

发明内容

本发明提供了一种数字加密装置及方法,旨在解决传统的数字加密装置存在的无法在适应不同的算法的同时减小硬件成本的问题。

一方面,本发明提供了一种数字加密装置,所述数字加密装置包括:

用于根据接收到的数据包生成控制信息和原始数据信息的数据解析模块;

与所述数据解析模块连接,用于根据所述控制信息生成k个使能信号;发送第1个使能信号,以使第1个硬件加密模块根据第1个使能信号和所述原始数据信息生成第1个中间数据信息和第1个反馈信息的流程控制模块;其中,k为硬件加密模块的个数,k为大于2的整数;

所述流程控制模块还用于依次根据第i-1个反馈信号发送第i个使能信号至第i个硬件加密模块并根据硬件加密模块的个数依次对i的值进行更新,以使第i个硬件加密模块根据第i-1个中间数据信息和所述第i个使能信号生成第i个中间数据信息并存储至存储模块,且发送第i个反馈信息至流程控制模块;

所述流程控制模块还用于当i大于等于k时,发送结束指令以使数据解析模块根据所述结束指令读取所述第i个中间数据信息;

与所述流程控制模块连接的k个硬件加密模块;

与所述数据解析模块和k个所述硬件加密模块连接的存储模块。

另一方面,本发明提供了一种数字加密方法,所述数字加密方法包括:

数据解析模块根据接收到的数据包生成控制信息和原始数据信息;

流程控制模块根据所述控制信息生成k个使能信号;其中,k为硬件加密模块的个数,k为大于2的整数;

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