[发明专利]一种基于混合互连架构的众核处理器有效
申请号: | 201910344889.8 | 申请日: | 2019-04-26 |
公开(公告)号: | CN110096475B | 公开(公告)日: | 2023-10-24 |
发明(设计)人: | 余宁梅;马文恒;王萌;靳鑫;盛启隆;孙嘉鸿 | 申请(专利权)人: | 西安理工大学 |
主分类号: | G06F15/173 | 分类号: | G06F15/173 |
代理公司: | 西安弘理专利事务所 61214 | 代理人: | 燕肇琪 |
地址: | 710048 陕*** | 国省代码: | 陕西;61 |
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摘要: | |||
搜索关键词: | 一种 基于 混合 互连 架构 处理器 | ||
1.一种基于混合互连架构的众核处理器,其特征在于,包括若干个核心,若干个核心连接构成横纵网络,每个核心通过传输路由与该核心在横纵网络中相邻的其它核心连接进行横向或纵向数据传输,用以高效实现网络通讯,每个核心还分别与该核心在横纵网络中相邻的其它核心直接连接进行数据传输,用以加速数据传输。
2.如权利要求1所述的一种基于混合互连架构的众核处理器,其特征在于,至少一个核心的内部逻辑电路包括共享数据缓存器,所述核心通过共享数据缓存器与该核心相邻的其它核心进行数据缓存实现数据共享。
3.如权利要求1所述的一种基于混合互连架构的众核处理器,其特征在于,还包括状态控制模块,每个核心均通过电源门控组件与所述状态控制模块连接,所述状态控制模块通过电源门控组件独立控制每个核心用以降低功耗。
4.如权利要求3所述的一种基于混合互连架构的众核处理器,其特征在于,所述电源门控组件包括开关元件,所述开关元件的输入端与所述状态控制模块连接,所述开关元件的输出端与所述核心的输入端连接,所述状态控制模块发送关断使能信号通过开关元件控制所述核心的关断与开通,所述核心的输出端与该核心连接的传输路由之间连接有隔离单元,所述核心还在与该核心相邻的其它核心直接连接的线路上连接有隔离单元,所述状态控制模块与所述隔离单元连接,所述状态控制模块发送隔离使能信号通过隔离单元阻断被关闭的上一级核心发送的不定态信息。
5.如权利要求1所述的一种基于混合互连架构的众核处理器,其特征在于,所述横纵网络包括多条由若干核心连接而成的横向支路、纵向支路,每条所述横向支路均与每条纵向支路交叉,每个核心位于交叉处,每个核心通过传输路由与该核心所在横向支路上相邻的其它核心连接进行横向数据传输,并且每个核心通过传输路由与该核心所在纵向支路上相邻的其它核心连接进行纵向数据传输。
6.如权利要求5所述的一种基于混合互连架构的众核处理器,其特征在于,每个核心均连接一个传输路由,每个核心连接的传输路由与该核心相邻的其它核心连接的传输路由连接。
7.如权利要求6所述的一种基于混合互连架构的众核处理器,其特征在于,所述传输路由包括分别沿东、西、南、北四个不同方向进行通讯的子路由,两个互相连接的传输路由的同方向子路由一一对应连接传递应答信号用以进行不同核心之间的数据交互询问,每个核心通过本地发送模块分别与传输路由的四个不同方向的子路由连接用以向与该核心相邻的其它核心连接的传输路由发送信息,每个核心通过本地接收模块分别与传输路由的四个不同方向的子路由连接用以接收与该核心相邻的其他核心连接的传输路由发出的信息。
8.如权利要求7所述的一种基于混合互连架构的众核处理器,其特征在于,每个所述子路由均包括有选择器Ⅰ,所述选择器Ⅰ的一个输入端通过FIFO存储器与上一级同方向的子路由的输出端连接,另一个输入端通过本地发送模块与所述核心连接,所述上一级同方向的子路由发出的请求信息经由FIFO存储器与所述核心经过本地发送模块发送的本地请求信息共同发送至选择器Ⅰ进行选择,用以输出请求信息至下一级同方向的子路由,所述上一级同方向的子路由发出的请求信息经由FIFO存储器还通过本地接收模块发送至所述核心。
9.如权利要求7所述的一种基于混合互连架构的众核处理器,其特征在于,每个子路由均包括有选择器Ⅱ,所述选择器Ⅱ的一个输入端与下一级同方向的子路由的输出端连接,另一个输入端通过本地接收模块与所述核心连接,所述下一级同方向的子路由发出的反馈信息与所述核心经过本地接收模块发送的本地反馈信息共同发送至选择器Ⅱ,以进行选择再通过寄存器发送反馈信息至上一级同方向的子路由,所述下一级同方向的子路由发出的反馈信息还经由本地发送模块发送至所述核心。
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