[发明专利]半导体器件沟道的制作方法、半导体器件及其制造方法有效

专利信息
申请号: 201910411962.9 申请日: 2019-05-17
公开(公告)号: CN110265358B 公开(公告)日: 2021-12-03
发明(设计)人: 余自强 申请(专利权)人: 上海新微技术研发中心有限公司
主分类号: H01L21/8234 分类号: H01L21/8234;H01L27/088
代理公司: 北京成创同维知识产权代理有限公司 11449 代理人: 蔡纯;张靖琳
地址: 201899 上海市嘉定区*** 国省代码: 上海;31
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摘要:
搜索关键词: 半导体器件 沟道 制作方法 及其 制造 方法
【权利要求书】:

1.一种半导体器件沟道的制作方法,其特征在于,包括:

在半导体衬底上形成第一外延层;

分别在所述半导体衬底的第一区域和第二区域对应的所述第一外延层上形成第二外延层和第三外延层,所述第二外延层的高度大于所述第三外延层的高度;

在所述第二外延层和所述第三外延层上形成第四外延层;

在所述第四外延层上形成第一保护层;

在所述第一区域和第二区域分别形成第一柱状叠层结构;

其中,分别在所述第一区域和第二区域对应的所述第一外延层上形成第二外延层和第三外延层的步骤包括:

在所述第二区域的第一外延层上形成硬掩层;

以所述硬掩层为掩膜,在所述第一区域的第一外延层上外延生长第二外延层;

去除所述第二区域的硬掩层;

在所述第二区域的第一外延层上外延生长第三外延层,

所述第二外延层和所述第三外延层提供晶体管的沟道。

2.根据权利要求1所述的制作方法,其特征在于,所述第一外延层和第四外延层分别形成晶体管的源区和漏区。

3.根据权利要求1所述的制作方法,其特征在于,所述第二外延层的高度为所述第三外延层高度的2~10倍。

4.根据权利要求1所述的制作方法,其特征在于,在所述第二区域的第一外延层上形成硬掩层的步骤包括:

在所述第一外延层上形成硬掩层;

去除所述第一区域的硬掩层。

5.一种半导体器件的制作方法,其特征在于,包括:

在半导体衬底上形成第一外延层;

分别在所述半导体衬底的第一区域和第二区域对应的所述第一外延层上形成第二外延层和第三外延层,所述第二外延层的高度大于所述第三外延层的高度;

在所述第二外延层和所述第三外延层上形成第四外延层;

在所述第四外延层上形成第一保护层;

在所述第一区域和第二区域分别形成第一柱状叠层结构;

在所述衬底表面和所述柱状叠层结构的表面形成栅极介质层;

在所述栅极介质层上形成保护层,牺牲层,保护层结构;

形成由所述保护层,牺牲层,保护层围绕所述第一柱状叠层结构的第二叠层结构;

去除所述牺牲层,暴露出所述半导体器件的沟道,并形成栅极区域,

其中,分别在所述第一区域和第二区域对应的所述第一外延层上形成第二外延层和第三外延层的步骤包括:

在所述第二区域的第一外延层上形成硬掩层;

以所述硬掩层为掩膜,在所述第一区域的第一外延层上外延生长第二外延层;

去除所述第二区域的硬掩层;

在所述第二区域的第一外延层上外延生长第三外延层,

所述第一外延层和第四外延层分别形成晶体管的源区和漏区,所述第二外延层和所述第三外延层提供晶体管的沟道。

6.根据权利要求5所述的制作方法,其特征在于,所述第二外延层的高度为所述第三外延层高度的2~10倍。

7.根据权利要求5所述的制作方法,其特征在于,在所述第二区域的第一外延层上形成硬掩层的步骤包括:

在所述第一外延层上形成硬掩层;

去除所述第一区域的硬掩层。

8.根据权利要求5所述的制作方法,其特征在于,在所述第一区域和第二区域分别形成第一柱状叠层结构的步骤包括:

在所述第一保护层上形成硬掩层;

在所述硬掩层上形成材料层;

在所述材料层上形成图案化的光致抗蚀剂层;

以所述光致抗蚀剂层为掩膜对所述硬掩层进行蚀刻;

以蚀刻后的硬掩层为掩膜对半导体结构进行蚀刻,在所述第一区域和第二区域分别形成第一柱状叠层结构。

9.根据权利要求5所述的制作方法,其特征在于,所述第一柱状叠层结构的横截面形状包括:圆形、三角形、四边形。

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