[发明专利]支持多声道输入功能的音频处理电路有效
申请号: | 201910457374.9 | 申请日: | 2019-05-29 |
公开(公告)号: | CN112019992B | 公开(公告)日: | 2021-07-09 |
发明(设计)人: | 蔡秋云 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | H04S3/00 | 分类号: | H04S3/00;G06F3/16;H04R3/12;H04R5/04 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 梁丽超 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 支持 多声道 输入 功能 音频 处理 电路 | ||
1.一种支持多声道输入功能的音频处理电路(100),包含:
多个模拟至数字转换器(110至140),设置成将多个声道(101至108)中的模拟音频信号(R1至R4、L1至L4)转换成相应的数字音频数据(DR1至DR4、DL1至DL4),其中,该多个模拟至数字转换器(110至140)包含一目标模拟至数字转换器(110),用于处理该多个声道(101至108)中的一目标声道(101)的模拟音频信号(R1);以及
一控制芯片(150),耦接于该多个模拟至数字转换器(110-140),设置成控制该多个模拟至数字转换器(110至140)的音频数据输出顺序、指示该目标模拟至数字转换器(110)在一目标时段内输出该目标声道(101)的音频数据(DR1)、并且指示该多个模拟至数字转换器(110至140)中的其余模拟至数字转换器(120至140)在该目标时段内不要输出音频数据;
其中,该控制芯片(150)还设置成依据该目标声道(101)的音频数据(DR1)的一接收时间点,定义出该目标声道(101)的一数据时序,再依据该目标声道(101)的数据时序定义出该多个声道(101至108)中的其余声道(102至108)的数据时序;
在该控制芯片(150)定义出该多个声道(101至108)的数据时序后,该多个模拟至数字转换器(110至140)会处理该多个声道(101-108)的模拟音频信号(R1至R4、L1至L4),并按照该控制芯片(150)设置的一指定顺序轮流输出该多个声道(101至108)的音频数据(DR1至DR4、DL1至DL4),以形成一序列数据信号(SDATA),而该控制芯片(150)则会根据该多个声道(101至108)的数据时序从该序列数据信号(SDATA)中分离出不同声道的数字音频数据(DR1至DR4、DL1至DL4)。
2.根据权利要求1所述的音频处理电路(100),其中,该控制芯片(150)还设置成产生一左右频率信号(LRCK),且该音频处理电路(100)还包含:
一分频电路(160),耦接于该控制芯片(150)与该多个模拟至数字转换器(110至140)中的每一个模拟至数字转换器(110至140)之间,设置成对该左右频率信号(LRCK)进行一分频运作,以产生频率低于该左右频率信号(LRCK)的一声道切换信号(CHSW);
其中,该多个模拟至数字转换器(110至140)中的每一个模拟至数字转换器(110至140)会依据该声道切换信号(CHSW)切换想要输出的音频数据的所属声道。
3.根据权利要求2所述的音频处理电路(100),其中,该控制芯片(150)还设置成指示该目标模拟至数字转换器(110)在该目标时段内不要输出其他声道(102)的音频数据(DL1)。
4.根据权利要求2所述的音频处理电路(100),其中,该控制芯片(150)是设置成依据该指定顺序与该目标声道(101)的数据时序,来定义出该多个声道(101至108)中的其余声道(102至108)的数据时序。
5.根据权利要求2所述的音频处理电路(100),其中,该控制芯片(150)还设置成在该目标时段之前,控制该多个模拟至数字转换器(110至140)的音频数据输出顺序,使得该多个模拟至数字转换器(110至140)按照该指定顺序轮流输出该多个声道(101至108)的音频数据。
6.根据权利要求2所述的音频处理电路(100),其中,该多个模拟至数字转换器(110至140)中的每一个模拟至数字转换器(110至140),皆为一双信道模拟至数字转换电路,负责处理该多个声道(101至108)中的一对左右声道的模拟音频信号。
7.根据权利要求6所述的音频处理电路(100),其中,该声道切换信号(CHSW)的频率是该左右频率信号(LRCK)的频率的N分之一,其中,N是大于1的正整数,且等于该多个模拟至数字转换器(110至140)中的模拟至数字转换器的总数。
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