[发明专利]阵列基板以及显示面板有效
申请号: | 201910497051.2 | 申请日: | 2019-06-10 |
公开(公告)号: | CN110085190B | 公开(公告)日: | 2021-08-24 |
发明(设计)人: | 王光加;黄世帅 | 申请(专利权)人: | 北海惠科光电技术有限公司;滁州惠科光电科技有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G02F1/1343;G02F1/1345 |
代理公司: | 广州华进联合专利商标代理有限公司 44224 | 代理人: | 熊文杰;景怀宇 |
地址: | 536000 广西壮族自治区北海市工业园北海大*** | 国省代码: | 广西;45 |
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摘要: | |||
搜索关键词: | 阵列 以及 显示 面板 | ||
1.一种阵列基板,其特征在于,包括:
多条扫描线,排列成多行,用于提供扫描信号;
多条数据线,排列成多列,用于提供数据信号,且与多条扫描线交叉排列而限定出多个呈多行多列排布的子像素区域,所述子像素区域用于设置子像素;
多个像素电极,位于各所述子像素区域内,用于接收所述数据信号;
多条公共走线,用于与各所述子像素区域内的所述像素电极形成存储电容,包括第一走线与第二走线;
每行所述子像素区域的各子像素区域内均设有第一走线,且同行各子像素区域内的第一走线通过第一连接线相互连接,所述第一连接线与所述数据线绝缘且交叠;
每行子像素区域均具有多个基本单元,各所述基本单元均包括m个子像素区域,m为大于1的正整数;设定x为从1一直取值到m的正整数变量,第n+(x-1)行子像素区域与第n+x行子像素区域的各基本单元中的第x个子像素区域内均设有第二走线,且同列第x个子像素区域内的第二走线通过第二连接线相互连接,所述第二连接线与所述扫描线绝缘且交叠,n为正整数。
2.根据权利要求1所述的阵列基板,其特征在于,所述第一走线与所述第二走线均与所述扫描线同层设置。
3.根据权利要求2所述的阵列基板,其特征在于,所述第二连接线与所述像素电极同层设置。
4.根据权利要求2所述的阵列基板,其特征在于,相邻两行子像素区域的同列子像素区域之间均设置有第一电极与第二电极,且需要第二走线相互连接的相邻两行子像素区域的同列子像素区域内的第二走线分别连接二者之间的第一电极与第二电极,并通过第一电极与第二电极与所述第二连接线连接。
5.根据权利要求4所述的阵列基板,其特征在于,相邻两行子像素区域的同列子像素区域之间均设置有与二者之间的第一电极与第二电极均连接的第二连接线。
6.根据权利要求2所述的阵列基板,其特征在于,每行所述子像素区域的第一走线贯穿各所述子像素区域。
7.根据权利要求1所述的阵列基板,其特征在于,所述第一走线与所述扫描线同层设置,所述第二走线与所述数据线同层设置,每行所述子像素区域的第一走线贯穿各所述子像素区域,相邻两行同列子像素区域内相连的第二走线贯穿该相邻两行同列子像素区域。
8.根据权利要求1-7任一项所述的阵列基板,其特征在于,像素电极包括主干、分支以及边框,所述边框包围所述主干与所述分支,所述分支由所述主干延伸至所述边框,所述公共走线与所述边框和/或主干相对设置而形成存储电容。
9.根据权利要求1-7任一项所述的阵列基板,其特征在于,每个所述基本单元的各子像素区域内的子像素均构成一个像素单元。
10.一种显示面板,其特征在于,包括权利要求1-9任一项所述的阵列基板。
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