[发明专利]用来管理一记忆装置的方法以及其相关的记忆装置有效
申请号: | 201910500269.9 | 申请日: | 2009-08-27 |
公开(公告)号: | CN110457231B | 公开(公告)日: | 2023-10-24 |
发明(设计)人: | 李俊坤;林财成 | 申请(专利权)人: | 慧荣科技(深圳)有限公司;慧荣科技股份有限公司 |
主分类号: | G06F12/02 | 分类号: | G06F12/02 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈亮 |
地址: | 518040 广东省深圳市福田区车公*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 用来 管理 记忆 装置 方法 及其 相关 | ||
本发明涉及一种用来管理一记忆装置的方法以及其相关的记忆装置,所述记忆装置包含至少一非遗失性内存组件,非遗失性内存组件包含多个区块,所述方法包含:记录这些区块中的至少一区块的使用信息;以及依据使用信息决定是否抹除这些区块的一部分,其中使用信息包含有效/无效页数量表,用来记录这些区块各自的有效/无效页数量,因此,本发明的方法与记忆装置可依据使用信息来有效率地管理区块的使用。
本申请是申请日为2009年08月27日、申请号为200910172850.9(分案申请号为201610265290.1)、发明创造名称为“用来管理一记忆装置的方法以及其相关的记忆装置”的中国发明申请的分案申请。
技术领域
本发明涉及数据通信中闪存(Flash Memory)的控制技术领域,更具体地说,涉及一种用来管理一记忆装置的方法以及其相关的记忆装置。
背景技术
当一主装置存取一记忆装置例如固态硬盘(Solid State Drive,SSD)时,该主装置于典型状况下会送出一存取指令与至少一对应的逻辑地址至该记忆装置。该记忆装置的一控制器接收该逻辑地址并藉由利用一逻辑实体地址链结表将该逻辑地址转换为一实体地址。如此,该控制器藉由利用该实体地址来存取该记忆装置的至少一物理内存组件。例如:该内存组件可用一个或多个闪存芯片(为了简明起见,其可称为快闪芯片)来实施。
该逻辑实体地址链结表可依照该内存组件中的一记忆单位来建立。例如:该逻辑实体地址链结表可依照区块或页来建立。当该逻辑实体地址链结表依照区块来建立时,该逻辑实体地址链结表可称为逻辑实体区块地址链结表。当该逻辑实体地址链结表依照页来建立时,该逻辑实体地址链结表可称为逻辑实体页地址链结表。另外,一逻辑实体页地址链结表可称为全局页地址链结表,其包含关于该记忆装置中的多个区块(或全部的区块)的诸页的链结关系。
假设该内存组件具有X个实体区块,且每一实体区块具有Y个实体页。在该逻辑实体地址链结表依照区块来建立的状况下,该相关的逻辑实体区块地址链结表的建立可透过读取每一实体区块的一页所储存的一逻辑区块地址以及记录该实体区块与相关的逻辑区块之间的关系来实现。为了建立该逻辑实体区块地址链结表,必须读取分别对应于该X个实体区块的X页,其中所需时间假设为x秒。
在该逻辑实体地址链结表依照页来建立的状况下,该相关的全局页地址链结表的建立可透过读取全部的实体区块的每一实体页所储存的一逻辑页地址以及记录该实体页与该相关的逻辑页之间的关系来实现。为了建立该全局页地址链结表,必须读取至少X·Y页,需要x·Y秒。若一区块具有1024页,则建立该全局页地址链结表所需时间是建立该逻辑实体区块地址链结表所需时间的1024倍,即1024·x秒;由于处理速度实在太慢了,此为令人无法接受的处理时间。亦即,当按照此方式实施该全局页地址链结表时,存取该记忆装置的整体效能会被拖垮。因此,需要一新颖的方法以便有效率地建立该逻辑实体地址链结表,并且需要相关方法以便管理透过该新颖的方法来运作的记忆装置。
发明内容
本发明要解决的技术问题在于,针对现有技术的上述缺陷,提供一种用来管理一记忆装置的方法以及其相关的记忆装置,以针对该记忆装置的一备用区(Spare Region)与一数据区的安排进行优化。
本发明解决其技术问题所采用的技术方案之一是:构造一种用来管理一记忆装置的方法,该记忆装置包含至少一非遗失性内存组件,每一非遗失性内存组件包含多个区块,该方法包含:
自一主装置接收一第一存取指令;
分析该第一存取指令以取得属于一第一逻辑区块的一第一主装置地址;
将该第一主装置地址链结至一实体区块;
自该主装置接收一第二存取指令;
分析该第二存取指令以取得属于一第二逻辑区块的一第二主装置地址,其中该第二逻辑区块异于该第一逻辑区块;以及
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