[发明专利]一种芯片的封装方法在审

专利信息
申请号: 201910522476.4 申请日: 2019-06-17
公开(公告)号: CN110233113A 公开(公告)日: 2019-09-13
发明(设计)人: 尹保冠;佘飞;田德文;宋青林 申请(专利权)人: 青岛歌尔微电子研究院有限公司
主分类号: H01L21/56 分类号: H01L21/56
代理公司: 北京博雅睿泉专利代理事务所(特殊普通合伙) 11442 代理人: 王昭智
地址: 266061 山东省*** 国省代码: 山东;37
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摘要:
搜索关键词: 离型基材 封装 基板 芯片 开口槽 开口槽位置 封装结构 相对两侧 芯片堆叠 芯片封装 芯片贴装 芯片占用 对基板 封装层 轻薄化 减小 粘接 电子产品 去除 贯通 覆盖
【说明书】:

发明公开了一种芯片的封装方法,包括以下步骤;提供基板,基板上形成有贯通其相对两侧的开口槽;提供离型基材,将所述离型基材粘接在基板的一侧,并覆盖所述开口槽;提供芯片,将芯片贴装在位于开口槽位置的离型基材上;对基板上远离所述离型基材的一侧进行封装,形成将芯片封装并固定在基板上的封装层;去除离型基材,得到芯片的封装结构。本公开的封装方法,不但提高了芯片与基板之间封装的可靠性,还可以减小芯片占用的空间,尤其是多个芯片堆叠时的厚度,从而降低了整个封装的厚度,这利于电子产品的轻薄化发展。

技术领域

本发明涉及封装领域,更具体地,涉及一种芯片的封装工艺。

背景技术

随着电子产品的小型化、轻薄化发展,厂商对芯片的封装提出了更高的要求。SIP封装(System In a Package系统级封装)是将多种功能芯片,包括处理器、存储器等功能芯片集成在一个封装内,从而实现一个基本完整的功能。

例如对于底部芯片较小而顶部芯片较大的封装结构,当底部芯片焊线之后,粘接支撑部以将顶部芯片支撑起来。这种封装结构,在利用注塑或者线上膜(film on wire,简称FOW)工艺进行封装的时候,由于顶部芯片与支撑部之间的区域狭小,经常会发生填充不完全的问题,造成封装的可靠性差。

对于存储器产品,为了增加存储容量,减小封装尺寸,常采用芯片堆叠的封装方式。两个芯片或者更多个芯片在厚度方向上通过支撑部或者线上膜工艺堆叠起来并进行封装,这种封装结构不利于现代电子产品的轻薄化发展。

发明内容

本发明的一个目的是提供一种芯片的封装方法的新技术方案。

根据本发明的第一方面,提供了一种芯片的封装方法,包括以下步骤;

S100:提供基板,基板上形成有贯通其相对两侧的开口槽;

S200:提供离型基材,将所述离型基材粘接在基板的一侧,并覆盖所述开口槽;

S300:提供芯片,将芯片贴装在位于开口槽位置的离型基材上;

S400:对基板上远离所述离型基材的一侧进行封装,形成将芯片封装并固定在基板上的封装层;

S500:去除离型基材,得到芯片的封装结构。

可选地,所述芯片的顶面与基板的顶面齐平,或者低于所述基板的顶面;在所述步骤S400后,还包括减薄所述封装层的步骤。

可选地,所述步骤S300中,所述芯片以其引脚朝向离型基材的方式贴装在离型基材上;所述步骤S500之后,还包括在基板上进行重新布线的步骤。

可选地,在进行重新布线的步骤之后,还包括切割得到多个独立的封装结构的步骤。

可选地,在所述步骤300中,将芯片通过引线导通到基板上;所述步骤S400中,将芯片及其引线封装并固定在基板上;

之后还包括在封装层上贴装另一芯片,并将该另一芯片通过引线导通到基板上的步骤;以及包括对该另一芯片进行再次封装的步骤,形成将该另一芯片封装在基板上的另一封装层。

可选地,所述步骤S300中,第一芯片以其引脚朝向离型基材的方式贴装在离型基材上,第二芯片以其引脚远离所述离型基材的方式贴装在第一芯片上,且第二芯片的引脚通过引线导通到基板上;

在所述步骤S400中,将第一芯片、第二芯片及第二芯片的引线封装并固定在基板上;

在所述步骤S500之后,还包括将第一芯片的引脚通过引线导通到基板上的步骤,以及包括从基板的另一侧对第一芯片及其引线进行再次封装的步骤。

可选地,通过点胶工艺从基板的另一侧对第一芯片及其引线进行再次封装。

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