[发明专利]软误差恢复锁存器在审

专利信息
申请号: 201910562680.9 申请日: 2019-06-26
公开(公告)号: CN110649919A 公开(公告)日: 2020-01-03
发明(设计)人: A·M·韦杰蒂;A·亚恩 申请(专利权)人: 意法半导体国际有限公司;意法半导体股份有限公司
主分类号: H03K19/003 分类号: H03K19/003;H03K19/0944
代理公司: 11256 北京市金杜律师事务所 代理人: 王茂华;郭星
地址: 荷兰斯*** 国省代码: 荷兰;NL
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摘要:
搜索关键词: 存储节点 锁存器 电源电压 存储 耦合到 配置 数据存储节点 存储数据位 存储状态 互补数据 软误差 补码 输出 响应 恢复
【权利要求书】:

1.一种电路,包括:

第一锁存器,包括:

多个存储节点,包括:

多个数据存储节点,每个数据存储节点被配置为存储具有两种状态中的一种状态的数据位,所述两种状态包括第一状态和第二状态;以及

多个互补数据存储节点,每个互补数据存储节点被配置为存储所述数据位的补码;以及

多个第一电压多依赖级,分别对应于所述多个存储节点,每个第一电压多依赖级具有被耦合到所述多个存储节点中的相应存储节点的输出、以及分别被耦合到所述多个存储节点中的至少两个其他存储节点的至少两个控制输入,所述第一电压多依赖级被配置为响应于分别存储在所述至少两个其他存储节点中的两个数据位的两个状态的变化,引起存储在所述存储节点中的所述数据位的所述状态从所述第二状态变为所述第一状态。

2.根据权利要求1所述的电路,其中所述第一锁存器包括:

多个第二电压多依赖级,分别对应于所述多个存储节点,每个第二电压多依赖级具有被耦合到所述多个存储节点中的所述相应存储节点的输出、以及分别被耦合到所述多个存储节点中的至少两个其他存储节点的至少两个控制输入,所述第二电压多依赖级被配置为响应于分别存储在所述至少两个其他存储节点中的两个数据位的两个状态的变化,引起存储在所述存储节点中的所述数据位的所述状态从所述第一状态变为所述第二状态。

3.根据权利要求1所述的电路,其中所述第一电压多依赖级被配置为当分别存储在所述至少两个其他存储节点中的所述两个数据位中的仅一个数据位改变状态时,或者当分别存储在所述至少两个其他存储节点中的所述两个数据位中的任何一个数据位都没有改变状态时,避免引起存储在所述存储节点中的所述数据位的所述状态从所述第二状态变为所述第一状态。

4.根据权利要求1所述的电路,其中所述第二电压多依赖级包括:

第一晶体管,具有被耦合到所述存储节点的第一传导端子、被耦合到所述至少两个其他存储节点中的第一存储节点的控制端子、以及第二传导端子;以及

第二晶体管,具有被耦合到所述第一晶体管的所述第二传导端子的第一传导端子、被耦合到提供第一电压的第一电压节点的第二传导端子、以及被耦合到所述至少两个其他存储节点中的第二存储节点的控制端子。

5.根据权利要求2所述的电路,其中所述第二电压多依赖级包括:

第一晶体管,具有被耦合到所述存储节点的第一传导端子、被耦合到所述至少两个其他存储节点中的第一存储节点的控制端子、以及第二传导端子;以及

第二晶体管,具有被耦合到所述第一晶体管的所述第二传导端子的第一传导端子、被耦合到提供第二电压的第二电压节点的第二传导端子、以及被耦合到所述至少两个其他存储节点中的第二存储节点的控制端子。

6.根据权利要求1所述的电路,其中所述第一锁存器包括:

第一输入级,被耦合到所述多个存储节点,并且被配置为:

接收具有两种时钟状态中的一种时钟状态的时钟信号,所述两种时钟状态包括第一时钟状态和第二时钟状态;

接收具有数据信号的数据信号;

响应于所述时钟信号具有所述第一时钟状态,基于所述数据信号状态来设置所述数据位和所述数据位的所述补码;以及

响应于所述时钟信号具有所述第二时钟状态,避免设置所述数据位和所述数据位的所述补码。

7.根据权利要求6所述的电路,包括:

第二锁存器,被耦合到所述第一锁存器,并且包括多个第二锁存器存储节点,所述第二锁存器被配置为:

接收所述时钟信号;

响应于所述时钟信号具有所述第二时钟状态,引起存储在所述多个存储节点中的数据分别被传输到所述多个第二锁存器存储节点。

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