[发明专利]像素驱动电路及其驱动方法、显示面板与显示装置有效
申请号: | 201910572723.1 | 申请日: | 2019-06-28 |
公开(公告)号: | CN110189701B | 公开(公告)日: | 2022-07-29 |
发明(设计)人: | 李永谦 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G09G3/3225 | 分类号: | G09G3/3225 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人: | 赵天月 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 像素 驱动 电路 及其 方法 显示 面板 显示装置 | ||
1.一种像素驱动电路,其特征在于,包括:
驱动电路,所述驱动电路的第一端与第一电源相连,所述驱动电路的第二端与发光元件相连;
储能电路,所述储能电路与所述驱动电路的控制端相连;
数据及感测线;
第一初始化电路,所述第一初始化电路与电压提供端、所述驱动电路的控制端和第三控制线相连;
第二初始化电路,所述第二初始化电路与所述数据及感测线、所述驱动电路的第二端和第二控制线相连;
数据写入电路,所述数据写入电路与所述数据及感测线、所述驱动电路的控制端和第一控制线相连;
其中,所述像素驱动电路的显示模式包括依次排列的显示初始化阶段、数据写入阶段和发光阶段,所述像素驱动电路的感测模式包括依次排列的感测初始化阶段、数据输出阶段和感测阶段,在所述显示模式的数据写入阶段,所述数据及感测线通过所述数据写入电路将数据电压写入所述驱动电路的控制端,在所述感测模式的数据输出阶段,所述数据及感测线接收所述驱动电路通过所述第二初始化电路输出的感测数据,以便获取所述驱动电路的外部补偿值,在所述感测模式之后与所述感测模式相邻的显示模式,利用所述驱动电路的外部补偿值将输入的图像数据转换为外部补偿图像数据,所述数据及感测线通过所述数据写入电路将对应于所述外部补偿图像数据的数据电压写入所述驱动电路的控制端;
在所述感测模式的感测初始化阶段,将所述电压提供端提供的基准电压输入到所述驱动电路的控制端,其中,所述驱动电路在基准电压的控制下,通过所述第二初始化电路输出感测数据,所述电压提供端通过所述第一初始化电路向所述驱动电路提供所述基准电压;
在所述显示模式的显示初始化阶段,将所述电压提供端提供的初始化电压提供至所述驱动电路的控制端,以对所述驱动电路的控制端进行初始化,并将所述数据及感测线提供的初始化电压提供至所述驱动电路的第二端,以对所述驱动电路的第二端进行初始化;
所述感测模式包括迁移率感测和驱动阈值感测,其中,
在开启显示过程中的两帧画面之间的空白时间执行迁移率感测;
在关闭显示过程中,执行驱动阈值感测;
在迁移率感测的数据输出阶段,所述第一初始化电路关断;在迁移率感测的感测阶段,将所述电压提供端提供的低电平电压写入所述驱动电路的控制端。
2.根据权利要求1所述的像素驱动电路,其特征在于,所述第一初始化电路包括:
第三晶体管,所述第三晶体管的第一极与所述电压提供端相连,所述第三晶体管的第二极与所述驱动电路的控制端相连,所述第三晶体管的控制极与所述第三控制线相连。
3.根据权利要求1所述的像素驱动电路,其特征在于,所述第二初始化电路包括:
第二晶体管,所述第二晶体管的第一极与所述数据及感测线相连,所述第二晶体管的第二极与所述驱动电路的第二端相连,所述第二晶体管的控制极与所述第二控制线相连。
4.根据权利要求1所述的像素驱动电路,其特征在于,所述数据写入电路包括:
第一晶体管,所述第一晶体管的第一极与所述数据及感测线相连,所述第一晶体管的第二极与所述驱动电路的控制端相连,所述第一晶体管的控制极与所述第一控制线相连。
5.根据权利要求1所述的像素驱动电路,其特征在于,
所述驱动电路包括驱动晶体管,所述驱动晶体管的第一极与所述第一电源相连,所述驱动晶体管的第二极与所述发光元件相连,所述驱动晶体管的控制极与所述储能电路、所述第一初始化电路和所述数据写入电路相连;
所述储能电路包括第一电容,所述第一电容的一端与所述驱动晶体管的控制极相连,所述第一电容的另一端与所述驱动晶体管的第二极相连。
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