[发明专利]基于AES算法的加密方法、用户设备、存储介质及装置有效
申请号: | 201910588609.8 | 申请日: | 2019-07-01 |
公开(公告)号: | CN110336658B | 公开(公告)日: | 2023-03-21 |
发明(设计)人: | 常兴;刘国松 | 申请(专利权)人: | 武汉能钠智能装备技术股份有限公司 |
主分类号: | H04L9/06 | 分类号: | H04L9/06 |
代理公司: | 深圳市恒程创新知识产权代理有限公司 44542 | 代理人: | 赵爱蓉 |
地址: | 430205 湖北省武汉市东湖新技术开发区武大*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 基于 aes 算法 加密 方法 用户 设备 存储 介质 装置 | ||
本发明涉及数据加密技术领域,公开了一种基于AES算法的加密方法、用户设备、存储介质及装置。本发明中在接收到高级加密标准AES算法加密请求时,根据所述AES算法加密请求确定明文数据;对所述明文数据进行分组,以获得数据组形式的待加密数据;以所述数据组为变换单位对所述待加密数据进行并行处理模式下的AES加密处理,以获得第一加密数据。明显地,本发明中将对AES算法进行流水线加密设计,从而并行处理AES加密操作。若如此,则无需在当前数据块的前端数据加密完成后再进行下一数据块的加密操作,通过将数据块拆解成多个分组并并行处理,解放了硬件环境下的加密速度,从而解决了AES算法无法保证加密速度的技术问题。
技术领域
本发明涉及数据加密技术领域,尤其涉及基于AES算法的加密方法、用户设备、存储介质及装置。
背景技术
在现代数据加密技术中,高级加密标准(Advanced Encryption Standard,AES)算法的应用非常广泛,较难破解。
特别地,当在对高速、大数据量且大位宽的数据进行加密时,多会采用专用集成电路(Application Specific Integrated Circuit,ASIC)来实施该AES算法以进行数据加密操作。
但是,通过ASIC芯片来运行AES算法还存在着一定的缺陷。比如,随着前端数据的输入,ASIC芯片的加密速度可能会小于前端数据的输入速度,无法跟上输入速度,明显地,ASIC芯片构建的硬件环境局限了AES算法的加密速度。
可见,AES算法存在着无法保证加密速度的技术问题。
上述内容仅用于辅助理解本发明的技术方案,并不代表承认上述内容是现有技术。
发明内容
本发明的主要目的在于提供基于AES算法的加密方法、用户设备、存储介质及装置,旨在解决AES算法无法保证加密速度的技术问题。
为实现上述目的,本发明提供一种基于AES算法的加密方法,所述基于AES算法的加密方法包括以下步骤:
在接收到高级加密标准AES算法加密请求时,根据所述AES算法加密请求确定明文数据;
对所述明文数据进行分组,以获得数据组形式的待加密数据;
以所述数据组为变换单位对所述待加密数据进行并行处理模式下的AES加密处理,以获得第一加密数据。
优选地,所述以所述数据组为变换单位对所述待加密数据进行并行处理模式下的AES加密处理,以获得第一加密数据,具体包括:
在所述数据组为目标数据组时,在并行处理模式下对与所述目标数据组对应的待加密数据通过预设列混淆模型进行组合运算,以获得运算数据;
对所述运算数据进行异或处理,以获得第一加密数据。
优选地,所述在所述数据组为目标数据组时,在并行处理模式下对与所述目标数据组对应的待加密数据通过预设列混淆模型进行组合运算,以获得运算数据,具体包括:
在所述数据组为目标数据组时,从预设列混淆模型中确定目标列混淆公式;
在并行处理模式下对与所述目标数据组对应的待加密数据通过所述目标列混淆公式进行组合运算,以获得运算数据。
优选地,所述对所述明文数据进行分组,以获得数据组形式的待加密数据之后,所述基于AES算法的加密方法还包括:
通过预设AES算法中的预设S盒对所述待加密数据进行字节映射,以获得与所述待加密数据对应的映射数据;
相应地,所述在所述数据组为目标数据组时,在并行处理模式下对与所述目标数据组对应的待加密数据通过预设列混淆模型进行组合运算,以获得运算数据,具体包括:
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