[发明专利]一种阵列基板及显示面板在审
申请号: | 201910750836.6 | 申请日: | 2019-08-14 |
公开(公告)号: | CN110517642A | 公开(公告)日: | 2019-11-29 |
发明(设计)人: | 薛炎;韩佰祥 | 申请(专利权)人: | 深圳市华星光电半导体显示技术有限公司 |
主分类号: | G09G3/3266 | 分类号: | G09G3/3266 |
代理公司: | 44300 深圳翼盛智成知识产权事务所(普通合伙) | 代理人: | 黄威<国际申请>=<国际公布>=<进入国 |
地址: | 518132 广东省深*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 栅极驱动电路 扫描信号 像素电路 阵列基板 低电位 振荡 发光元件 设置电压 维持电路 显示面板 制备 输出 申请 | ||
1.一种阵列基板,其特征在于,包括对应显示区的像素电路以及对应所述显示区外围设置的第一扫描驱动电路和第二扫描驱动电路,所述像素电路包括开关电路、电压维持电路、驱动元件以及发光元件;
所述第一扫描驱动电路包括输出电路,所述输出电路耦接于第一节点并接入时钟信号,用于根据所述第一节点输出的第一节点控制信号和所述时钟信号输出扫描信号;所述第二扫描驱动电路用于输出发光控制信号;
所述开关电路接入数据信号,并且与所述第一扫描驱动电路的所述输出电路连接,用于根据所述扫描信号控制所述数据信号的输入;
所述驱动元件与所述开关电路连接,且接入高电压信号,用于根据所述扫描信号与所述数据信号驱动所述发光元件发光;其中,
所述电压维持电路接入恒压低电位,且并联连接所述开关电路与所述第一扫描驱动电路,所述电压维持电路的输入端连接至所述第二扫描驱动电路的输出端,所述电压维持电路用于在所述输出电路输出的所述扫描信号为低电位时维持所述扫描信号的低电位不变。
2.根据权利要求1所述的阵列基板,其特征在于,所述开关电路包括第一薄膜晶体管,所述第一薄膜晶体管的栅极与所述输出电路的输出端连接,所述第一薄膜晶体管的源极接入所述数据信号,所述第一薄膜晶体管的漏极与所述驱动元件连接。
3.根据权利要求2所述的阵列基板,其特征在于,所述驱动元件包括第二薄膜晶体管,所述第二薄膜晶体管的栅极与所述第一薄膜晶体管的漏极连接,所述第二薄膜晶体管的源极接入所述高电压信号,所述第二薄膜晶体管的漏极与所述发光元件的第一电极连接,所述发光元件的第二电极接入公共接地信号。
4.根据权利要求3所述的阵列基板,其特征在于,所述像素电路还包括存储电容,所述存储电容的第一极板与所述第二薄膜晶体管的栅极并联连接至所述第一薄膜晶体管的漏极,所述存储电容的第二极板与所述第二薄膜晶体管的漏极并联连接至所述发光元件的所述第一电极。
5.根据权利要求2所述的阵列基板,其特征在于,所述电压维持电路包括第三薄膜晶体管,所述第三薄膜晶体管的栅极连接所述第二扫描驱动电路的输出端,所述第三薄膜晶体管的源极接入所述恒压低电位,所述第三薄膜晶体管的漏极并联连接所述输出电路的输出端以及所述第一薄膜晶体管的栅极。
6.根据权利要求1所述的阵列基板,其特征在于,所述输出电路包括第四薄膜晶体管,所述第四薄膜晶体管的栅极耦接于所述第一节点,所述第四薄膜晶体管的源极电性连接于所述时钟信号,所述第四薄膜晶体管的漏极连接于所述输出电路的输出端。
7.根据权利要求1所述的阵列基板,其特征在于,当所述输出电路输出的所述扫描信号为高电位时,所述第二扫描驱动电路输出的所述发光控制信号为低电位,所述电压维持电路关闭,所述开关电路导通,所述数据信号输入至所述驱动元件;
当所述输出电路输出的所述扫描信号为低电位时,所述第二扫描驱动电路输出的所述发光控制信号升至高电位,所述电压维持电路导通,所述开关电路关闭,所述电压维持电路用于维持所述扫描信号的低电位不变。
8.根据权利要求7所述的阵列基板,其特征在于,所述发光控制信号的脉冲宽度大于所述扫描信号的脉冲宽度。
9.根据权利要求1所述的阵列基板,其特征在于,所述像素电路还包括补偿电路,所述补偿电路的输入端接入所述第二扫描驱动电路的输出端,所述补偿电路的输出端连接至所述驱动元件,所述发光控制信号用于控制所述补偿电路。
10.一种显示面板,其特征在于,包括如权利要求1~9任一权利要求所述的阵列基板,以及制备于所述阵列基板上的有机发光层。
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