[发明专利]移位暂存装置与显示装置有效

专利信息
申请号: 201910832250.4 申请日: 2019-09-04
公开(公告)号: CN110459163B 公开(公告)日: 2023-03-28
发明(设计)人: 林炜力 申请(专利权)人: 友达光电股份有限公司
主分类号: G09G3/20 分类号: G09G3/20;G11C19/28
代理公司: 隆天知识产权代理有限公司 72003 代理人: 李琛;黄艳
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 移位 暂存 装置 显示装置
【权利要求书】:

1.一种移位暂存装置,包括:

多级彼此串接在一起的移位暂存器,根据多个时钟信号输出多个扫描信号至一显示面板,其中第n级移位暂存器根据第n个时钟信号输出该扫描信号,且包括:

一驱动晶体管,受控于一本级驱动信号,其第一端接收该第n个时钟信号,其第二端输出该第n级移位暂存器的扫描信号;

一上拉电路,受控于该本级驱动信号并耦接一参考高电压,用以输出给第(n+2)级移位暂存器的驱动信号,其中该上拉电路用以在该第n个时钟信号的使能时间中基于该参考高电压开始上拉该第(n+2)级移位暂存器的驱动信号;

一下拉控制晶体管,耦接该上拉电路且受控于第(n+4)级移位暂存器的扫描信号,用以控制该上拉电路停止输出给该第(n+2)级移位暂存器的驱动信号;以及

一上拉控制晶体管,受控于第(n-2)级移位暂存器的扫描信号,其第一端耦接该上拉电路,其第二端耦接一参考低电压,

其中n为大于或等于3的整数。

2.如权利要求1所述的移位暂存装置,其中,当该些时钟信号的使能时间彼此不重叠时,该上拉控制晶体管被控制以使该上拉电路在第(n+1)个时钟信号的使能时间中保持该第(n+2)级移位暂存器的驱动信号被上拉后的电压电平。

3.如权利要求1所述的移位暂存装置,其中该上拉电路包括:

一第一上拉晶体管,受控于该本级驱动信号,其第一端耦接该参考高电压,其第二端提供一启动电压;以及

一第二上拉晶体管,其栅极端耦接该第一上拉晶体管的第二端与该上拉控制晶体管的第一端,且接收该启动电压,其第一端与其栅极端耦接在一起或者其第一端耦接该参考高电压,以及其第二端输出给该第(n+2)级移位暂存器的驱动信号。

4.如权利要求3所述的移位暂存装置,其中该上拉控制晶体管的尺寸不同于该第一上拉晶体管的尺寸。

5.如权利要求4所述的移位暂存装置,其中该上拉控制晶体管的通道宽度大于该第一上拉晶体管的通道宽度。

6.如权利要求3所述的移位暂存装置,其中,在第(n+1)个时钟信号的使能时间中,该上拉控制晶体管被关闭,且该第一上拉晶体管与该第二上拉晶体管被导通,该第(n+2)级移位暂存器的驱动信号持续被该参考高电压上拉。

7.如权利要求1所述的移位暂存装置,其中该第n级移位暂存器还包括:

一下拉电路,耦接于该参考低电压与该驱动晶体管的第二端之间且受控于该第(n+4)级移位暂存器的扫描信号,用以下拉该第n级移位暂存器的扫描信号。

8.如权利要求7所述的移位暂存装置,其中该下拉电路包括:

一第一下拉晶体管,受控于该第(n+4)级移位暂存器的扫描信号,其第一端耦接该驱动晶体管的栅极端,其第二端耦接该参考低电压;以及

一第二下拉晶体管,受控于该第(n+4)级移位暂存器的扫描信号,其第一端耦接该驱动晶体管的第二端,其第二端耦接该参考低电压。

9.如权利要求1所述的移位暂存装置,还包括:

一第一稳压电路与一第二稳压电路,耦接该驱动晶体管的第二端且接收该本级驱动信号,其中该第一稳压电路与该第二稳压电路用以根据该本级驱动信号稳压该第n级移位暂存器的扫描信号。

10.如权利要求1所述的移位暂存装置,其中,

在第(n-2)个时钟信号的使能时间中,该本级驱动信号从一第一电平被改变至一第二电平,其中该第二电平大于该第一电平;

在第(n-1)个时钟信号的使能时间中,该本级驱动信号被保持在不小于该第二电平的状态;以及

在该第n个时钟信号的使能时间中,该本级驱动信号被改变至一第三电平,其中该第三电平大于该第二电平。

11.如权利要求1所述的移位暂存装置,其中该参考高电压为一直流高电压。

12.一种显示装置,包括:

一显示面板;以及

一移位暂存装置,包括多级彼此串接在一起的移位暂存器,根据多个时钟信号分别输出一扫描信号至该显示面板,其中第n级移位暂存器根据第n个时钟信号输出该扫描信号,且包括:

一驱动晶体管,受控于一本级驱动信号,其第一端接收该第n个时钟信号,其第二端输出该第n级移位暂存器的扫描信号;

一上拉电路,受控于该本级驱动信号并耦接一参考高电压,用以输出给第(n+2)级移位暂存器的驱动信号,其中该上拉电路用以在该第n个时钟信号的使能时间中基于该参考高电压开始上拉该第(n+2)级移位暂存器的驱动信号;

一下拉控制晶体管,耦接该上拉电路且受控于第(n+4)级移位暂存器的扫描信号,用以控制该上拉电路停止输出给该第(n+2)级移位暂存器的驱动信号;以及

一上拉控制晶体管,受控于第(n-2)级移位暂存器的扫描信号,其第一端耦接该上拉电路,其第二端耦接一参考低电压,

其中n为大于或等于3的整数。

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