[发明专利]一种FPGA芯片及其互联控制方法在审
申请号: | 201910865989.5 | 申请日: | 2019-09-12 |
公开(公告)号: | CN112486895A | 公开(公告)日: | 2021-03-12 |
发明(设计)人: | 王平;蒋佳立;龙欣;杨靖驰 | 申请(专利权)人: | 阿里巴巴集团控股有限公司 |
主分类号: | G06F15/173 | 分类号: | G06F15/173 |
代理公司: | 北京鼎佳达知识产权代理事务所(普通合伙) 11348 | 代理人: | 刘铁生;孟阿妮 |
地址: | 英属开曼群岛大开*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 一种 fpga 芯片 及其 控制 方法 | ||
1.一种FPGA芯片,其特征在于,所述FPGA芯片包括静态逻辑区和动态逻辑区,所述静态逻辑区中设置有路由逻辑单元与互联逻辑单元,其中,
路由逻辑单元用于根据路由规则判断接收到的第一数据是否发送给互联逻辑单元;
互联逻辑单元分别连接所述动态逻辑区与所述路由逻辑单元,用于将动态逻辑区的待发送数据打包为第二数据发送至路由逻辑单元,或者将路由逻辑单元发送的第一数据发送至动态逻辑区。
2.根据权利要求1所述的FPGA芯片,其特征在于,所述FPGA芯片还包括:输入网口与输出网口;
所述输入网口连接所述路由逻辑单元,用于接收第一FPGA芯片发送的第一数据,所述第二FPGA芯片与所述FPGA芯片直连;
所述输出网口连接所述路由逻辑单元,用于发送第二数据至第二FPGA芯片,所述第二FPGA芯片与所述FPGA芯片直连;
所述输出网口还用于将所述路由逻辑单元确定不发送至互联逻辑单元的第一数据发送至第二FPGA芯片。
3.根据权利要求1所述的FPGA芯片,其特征在于,所述路由逻辑单元还用于,通过预置接口接收管控服务器发送的路由规则,所述管控服务器中运行有确定路由规则的管控系统,所述路由规则用于识别第一数据中的用户标识信息是否与所述FPGA芯片的用户标识信息相同,若相同,则将所述第一数据发送给互联逻辑单元,否则将第一数据发送给相邻的FPGA芯片。
4.一种FPGA芯片的互联控制方法,其特征在于,所述FPGA芯片中设置有路由逻辑单元与互联逻辑单元,所述方法包括:
路由逻辑单元通过输入网口接收第一FPGA芯片发送的第一数据,所述第一FPGA芯片与所述FPGA芯片直连;
路由逻辑单元根据路由规则判断是否将所述第一数据发送至互联逻辑单元;
若否,则将所述第一数据通过输出网口发送至第二FPGA芯片,所述第二FPGA芯片与所述芯片直连。
5.根据权利要求4所述的方法,其特征在于,所述方法还包括:
由互联逻辑单元将所述FPGA芯片的待发送数据打包为第二数据发送至路由逻辑单元,所述第二数据中含有所述FPGA芯片对应的用户标识信息;
所述路由逻辑单元将所述第二数据通过输出网口发送至第二FPGA芯片。
6.根据权利要求4所述的方法,其特征在于,路由逻辑单元根据路由规则判断是否将所述第一数据发送至互联逻辑单元,包括:
对比所述第一数据中的用户标识信息与所述FPGA芯片对应的用户标识信息;
若相同,则将所述第一数据发送至互联逻辑单元;
若不同,则执行将所述第一数据通过输出网口发送至第二FPGA芯片的操作。
7.根据权利要求6所述的方法,其特征在于,所述路由逻辑单元与互联逻辑单元设置在所述FPGA芯片的静态逻辑区中,在将所述第一数据发送至互联逻辑单元之后,所述方法还包括:
由互联逻辑单元将所述第一数据发送至动态逻辑区。
8.根据权利要求4所述的方法,其特征在于,所述方法还包括:
所述路由逻辑单元接收管控服务器发送的路由规则,所述管控服务器中运行有确定路由规则的管控系统,所述管控系统基于FPGA芯片的系统拓扑结构确定对应FPGA芯片的路由规则,其中,所述系统拓扑结构用于表示具有相同用户标识信息的FPGA芯片,所述路由规则用于识别第一数据中的用户标识信息是否与所述第一FPGA芯片的用户标识信息相同,若相同,则将所述第一数据发送给互联逻辑单元,否则将第一数据发送给第二FPGA芯片;
所述路由逻辑单元更新本地存储的路由规则。
9.一种基于FPGA芯片的服务系统,其特征在于,所述服务系统中含有多个FPGA芯片,所述FPGA芯片之间两两直连,其中,FPGA芯片采用权利要求1-3中任一项所述的FPGA芯片。
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