[发明专利]可自主回复写应答的AXI总线传输装置有效
申请号: | 201910905083.1 | 申请日: | 2019-09-24 |
公开(公告)号: | CN110659236B | 公开(公告)日: | 2023-04-07 |
发明(设计)人: | 朱苏雁;刘大铕;王运哲;孙中琳;刘尚;刘奇浩 | 申请(专利权)人: | 山东华芯半导体有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40;G06F13/42;G06F11/30 |
代理公司: | 济南泉城专利商标事务所 37218 | 代理人: | 赵玉凤 |
地址: | 250101 山东省济南市高新*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 自主 回复 应答 axi 总线 传输 装置 | ||
1.可自主回复写应答的AXI总线传输装置,其特征在于:本装置连接于AXI总线与本地总线之间,用于代替从设备返回写应答,本装置包括FIFO_A、FIFO_B、计数模块、对比模块以及选择器;FIFO_A与AXI总线相连,用于存放接收的AW通道发送的写命令中的awid和awlen信号,awid表示写命令的ID,每条写命令都有对应的ID值,awlen表示写命令中的写数据传输长度信息;计数模块与AXI总线相连,用于对实际接收到的有效数据进行计数,并将记录的实际数据传输长度信息写入FIFO_B中;FIFO_B的输入端与计数模块的输出端相连,用于存放实际数据接收长度信息;对比模块的输入端分别与FIFO_A和FIFO_B的输出端相连,用于对比FIFO_A与FIFO_B中存放的长度值是否相等,如果相等,输出0,否则输出2,0表示正确,2表示传输错误;选择器的输入端分别与对比模块的输出端和2相连,选择器的使能端连接lclk_dis和lrst,lclk_dis为从设备模块时钟关断信号,有效表示从设备模块时钟关断,lrst为从设备模块复位信号,有效表示从设备当前处于复位状态,如果当前lclk_dis或lrst有效,则选择输出2,否则输出对比模块的结果;选择器的输出为bresp,FIFO_A中的id值直接赋给bid,bresp和bid为本装置返回的写应答。
2.根据权利要求1所述的可自主回复写应答的AXI总线传输装置,其特征在于:计数模块与AXI总线的写数据通道W相连,写数据通道W中的写最后信号wlast决定计数模块的工作状态;W通道接收到有效数据,且当前wlast低无效时,计数模块从0开始计数,W通道每收到一个有效数据且wlast信号无效,计数值加1,当wlast高有效时,计数模块将当前记录的实际数据传输长度信息写入FIFO_B中,并将计数器清零。
3.根据权利要求1所述的可自主回复写应答的AXI总线传输装置,其特征在于:FIFO_A与AXI总线的写命令通道AW相连,AW通道接收到有效的AXI写命令,将awid、awlen信号值存入FIFO_A中。
4.根据权利要求1所述的可自主回复写应答的AXI总线传输装置,其特征在于:当FIFO_A和FIFO_B都不为空时,对比模块同时读取这两个FIFO中的值一次,其中FIFO_A中存放的id值赋给bid,并且对比这两个FIFO中存放的长度值是否相等,如果相等,输出0,否则输出2。
5.根据权利要求1或3所述的可自主回复写应答的AXI总线传输装置,其特征在于:FIFO_A可以连续或者间断地接收多条AXI写命令,针对每条写命令,计数模块都进行一次计数。
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