[发明专利]一种MIL-STD-1553B总线协议控制器在审
申请号: | 201910905187.2 | 申请日: | 2019-09-24 |
公开(公告)号: | CN110659242A | 公开(公告)日: | 2020-01-07 |
发明(设计)人: | 殷庆会;桂江华;赵达 | 申请(专利权)人: | 中国电子科技集团公司第五十八研究所 |
主分类号: | G06F13/42 | 分类号: | G06F13/42 |
代理公司: | 32340 无锡派尔特知识产权代理事务所(普通合伙) | 代理人: | 杨立秋 |
地址: | 214000 *** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 总线协议控制器 并串转换模块 串并转换模块 存储器模块 仲裁器 配置寄存器模块 曼彻斯特编码 协议控制单元 译码模块 航空航天领域 集成电路设计 互连总线 总线传输 可配置 均和 灵活 | ||
1.一种MIL-STD-1553B总线协议控制器,与外部处理器相连,其特征在于,所述MIL-STD-1553B总线协议控制器包括仲裁器、配置寄存器模块、存储器模块、协议控制单元、并串转换模块、串并转换模块、曼彻斯特编码模块和曼彻斯特译码模块;其中,
所述仲裁器、所述存储器模块、所述配置寄存器模块、所述并串转换模块、所述串并转换模块均和所述协议控制单元相连,所述协议控制单元发起并控制1553B总线上的所有数据传输;
所述仲裁器和所述存储器模块相连,所述仲裁器用于避免所述处理器和所述协议控制单元访问内存时产生冲突;所述存储器模块存储1553B总线传输消息以及对应的控制信息;
所述并串转换模块和所述曼彻斯特编码模块相连,所述串并转换模块和所述曼彻斯特译码模块相连;所述串并转换模块和所述并串转换模块分别进行串行数据和并行数据间的转换,所述曼彻斯特编码模块和所述曼彻斯特译码模块分别对数据进行编码和译码,其外部输入输出均与1553B总线相连接。
2.如权利要求1所述的MIL-STD-1553B总线协议控制器,其特征在于,所述MIL-STD-1553B总线协议控制器还包括处理器接口单元,所述仲裁器、所述存储器模块和所述配置寄存器模块均与所述处理器接口单元相连,所述MIL-STD-1553B总线协议控制器通过所述处理器接口单元与外部处理器连接。
3.如权利要求2所述的MIL-STD-1553B总线协议控制器,其特征在于,所述处理器接口单元能够使所述处理器并行处理任务,以提高数据处理效率。
4.如权利要求1所述的MIL-STD-1553B总线协议控制器,其特征在于,所述配置寄存器模块通过配置包括寄存器以及消息计数器在内的信息,实现对所述1553B总线数据传输的控制。
5.如权利要求1所述的MIL-STD-1553B总线协议控制器,其特征在于,所述存储器模块包括堆栈指针、消息计数器、消息描述符块和消息块部分,所述存储器模块通过堆栈存储消息的详细信息,每条消息保存在指定的消息块区域中,所述堆栈指针指向每个消息的块状态地址。
6.如权利要求5所述的MIL-STD-1553B总线协议控制器,其特征在于,所述存储器模块的堆栈指针指向每个消息的块状态地址,堆栈指针的值每次增加3,每条消息处理完成后,消息计数器的值增加1。
7.如权利要求1所述的MIL-STD-1553B总线协议控制器,其特征在于,所述曼彻斯特编码模块和所述曼彻斯特译码模块采用双相曼彻斯特Ⅱ编码方案,对16位信息字段进行编码,译码器识别和确认同步脉冲,解码数据位并执行数据奇偶校验。
8.如权利要求1所述的MIL-STD-1553B总线协议控制器,其特征在于,通过如下流程进行数据传输:
步骤一:在空闲状态时,所述MIL-STD-1553B总线协议控制器持续监测start开始信号;
步骤二:获取有效的开始信号后,进行message初始化操作,并传输命令字;
步骤三:当发送/接收信号为高时,代表控制远程终端传输数据;
步骤四:远程终端接收到控制字,远程终端先发送状态字,再发送数据;
步骤五:如果步骤三中的发送/接收信号为低时,代表远程终端接收数据,当远程终端接收到命令字和数据字时,远程终端发送状态字指示无错误接收;
步骤六:所述MIL-STD-1553B总线协议控制器进入消息间隔时间,消息间隔时间结束后,返回步骤二,进行消息初始化;
步骤七:不进行数据传输时,所述MIL-STD-1553B总线协议控制器返回步骤一,进入空闲状态。
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