[发明专利]一种设备功耗动态调整方法及系统有效

专利信息
申请号: 201910951052.X 申请日: 2019-10-08
公开(公告)号: CN112636932B 公开(公告)日: 2022-08-30
发明(设计)人: 程川 申请(专利权)人: 烽火通信科技股份有限公司
主分类号: H04L12/10 分类号: H04L12/10;H04L49/10;H04L49/40;H04L43/00
代理公司: 武汉智权专利代理事务所(特殊普通合伙) 42225 代理人: 沈林华
地址: 430000 湖北省武*** 国省代码: 湖北;42
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摘要:
搜索关键词: 一种 设备 功耗 动态 调整 方法 系统
【权利要求书】:

1.一种设备功耗动态调整方法,其用于单盘功耗的动态调整,所述单盘为业务盘或交换盘,所述业务盘和交换盘之间有serdes通道连接,其特征在于,包括以下步骤:

在本端单盘与对端单盘之间建立状态监控通道,本端单盘通过状态监控通道获取对端单盘的状态信息;

获取本端单盘的SerDes通道连接关系,根据对端单盘的状态信息和SerDes通道连接关系,控制本端单盘的SerDes通道的供电使能;

在本端单盘与对端单盘之间建立状态监控通道,本端单盘通过状态监控通道获取对端单盘的状态信息,具体包括以下步骤:

在本端单盘与对端单盘之间加入状态监控通道;

通过状态监控通道在本端单盘与对端单盘之间建立连接;

若建立连接成功,本端单盘通过状态监控通道获取对端单盘的状态信息并保存在本端单盘中;

若建立连接不成功,获取本端单盘的SerDes通道的自协商信息,根据SerDes通道的自协商信息得出对端单盘不在位状态,将对端单盘的不在位状态存储在本端单盘中,并重复尝试建立连接直至建立连接成功;

其中,所述本端单盘为业务盘和交换盘中的其中一个,所述对端单盘为业务盘和交换盘中的另外一个。

2.如权利要求1所述的方法,其特征在于,所述状态监控通道为本端单盘与对端单盘之间,采用自定义的1-wire总线,物理上为两根3.3V LVTTL电平的信号线。

3.如权利要求1所述的方法,其特征在于:

对端单盘为业务盘时,所述对端单盘的状态信息包括单盘在位状态、单盘初始化状态和面板端口使用数量;

对端单盘为交换盘时,所述对端单盘的状态信息包括单盘在位状态、单盘初始化状态。

4.如权利要求1所述的方法,其特征在于,获取本端单盘的SerDes通道连接关系,根据对端单盘的状态信息和SerDes通道连接关系,控制本端单盘的SerDes通道的供电使能,具体包括以下步骤:

根据对端单盘的状态信息,查找本端单盘的映射表项,所述映射表项用于记录本端单盘的SerDes通道连接关系,得出需调整的SerDes通道信息;

根据需调整的SerDes通道信息,下发打开或者关闭对应SerDes通道的供电使能的配置,控制交换芯片打开或者关闭对应的SerDes通道的供电使能。

5.一种设备功耗动态调整系统,其特征在于:所述系统包括交换盘、业务盘和设于交换盘与业务盘之间的状态监控通道;

交换盘和业务盘均包括FPGA逻辑模块、CPU处理模块和交换芯片,其中:

FPGA逻辑模块,其用于:通过状态监控通道在本端单盘与对端单盘之间建立连接,通过状态监控通道获取对端单盘的状态信息存储在本端单盘中,发送中断信息至CPU处理模块;

CPU处理模块,其用于:接收FPGA逻辑模块发送的中断信息,获取本端单盘中存储的SerDes通道连接关系及对端单盘的状态信息;根据对端单盘的状态信息和SerDes通道连接关系,下发控制本端单盘的SerDes通道的供电使能的配置至交换芯片;

交换芯片,其用于:根据CPU处理模块下发的控制本端单盘的SerDes通道的供电使能的配置,打开或者关闭对应的SerDes通道;

所述FPGA逻辑模块包括FPGA状态监控单元、FPGA寄存器单元和FPGA中断处理单元:

FPGA状态监控单元,其用于:通过状态监控通道在本端单盘与对端单盘之间建立连接;若建立连接成功,通过状态监控通道获取对端单盘的状态信息并保存在FPGA寄存器单元中;若建立连接不成功,获取本端单盘FPGA寄存器单元中的SerDes通道的自协商信息,根据SerDes通道的自协商信息得出对端单盘不在位状态,将对端单盘的不在位状态存储在FPGA寄存器单元中,并重复尝试建立连接直至建立连接成功;

FPGA寄存器单元,其用于:存储对端单盘的状态信息、SerDes高速总线的自协商信息和对端单盘不在位状态;

FPGA中断处理单元,其用于:发送中断信息至本端单盘的CPU处理模块;

其中,所述本端单盘为业务盘和交换盘中的其中一个,所述对端单盘为业务盘和交换盘中的另外一个。

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