[发明专利]数据处理方法及相关产品有效

专利信息
申请号: 201910984580.5 申请日: 2019-10-16
公开(公告)号: CN110908826B 公开(公告)日: 2021-04-20
发明(设计)人: 姜一扬;张黄鹏 申请(专利权)人: 长江存储科技有限责任公司
主分类号: G06F11/10 分类号: G06F11/10;G06F3/06;G11C16/34
代理公司: 广州三环专利商标代理有限公司 44202 代理人: 郝传鑫;熊永强
地址: 430074 湖北省武汉市洪山区东*** 国省代码: 湖北;42
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摘要:
搜索关键词: 数据处理 方法 相关 产品
【说明书】:

本申请实施例公开了一种数据处理方法及相关产品,通过获取原始数据并将原始数据存储到存储器中的第一存储区;若原始数据的存储周期超过第一预设时长,则在原始数据存储周期内的任一中间时刻,读取第一存储区在中间时刻所存储的中间数据,并将中间数据存储到所述存储器中的第二存储区,在需要读取所述原始数据的读取时刻,读取第二存储区在读取时刻所存储的第二数据,并读取第一存储区在读取时刻所存储的第一数据,根据第二数据对第一存储区的第一数据进行纠错,得到修正后的原始数据,如此,能够通过提前存储任一中间时刻的中间数据,并在读取时刻根据中间数据进行纠错,在原始数据存储周期较长的情况下,能够保持纠错码模块较强的纠错能力。

技术领域

本申请涉及存储技术领域,具体涉及一种数据处理方法及相关产品。

背景技术

在有些存储器存储通道中,先验误差是随机的,现有技术中通过纠错码对码字中的随机错误进行纠正。一般来说,为了满足更强的纠错能力的需求,会应用强大的纠错码。当同时存在存储周期较长的数据和存储周期较短的数据时,存储周期较短的数据不需要太高的校验能力,这是因为,使用更强的纠错码对其进行纠错,纠错码模块的硬件利用率会更高或者编码速率更低,若使用校验能力不太高的纠错码模块,可降低硬件利用率,但是,当存储周期较长的数据中的数据错误超过纠错码模块的纠错容量时,会因为无法对全部数据错误进行纠错而导致无法读取正确的原始数据。因此,如何在降低纠错码模块的硬件利用率的前提下,保持纠错码模块较强的纠错能力的问题需要考虑。

发明内容

本申请实施例提供了一种数据处理方法及相关产品,能够通过提前存储中间时刻的中间数据,并在读取时刻根据中间数据进行纠错,从而能降低纠错码模块的硬件利用率,并保持其较强的纠错能力。

第一方面,本申请实施例提供一种数据处理方法,所述方法包括:

获取原始数据并将所述原始数据存储到存储器中的第一存储区;

若所述原始数据的存储周期超过第一预设时长,则在所述原始数据存储周期内的任一中间时刻,读取所述第一存储区在所述中间时刻所存储的中间数据,并将所述中间数据存储到所述存储器中的第二存储区,其中,所述中间数据为所述原始数据在所述任一中间时刻在所述第一存储区的表现形式;以及

在需要读取所述原始数据的读取时刻,读取所述第二存储区在所述读取时刻所存储的第二数据,并读取所述第一存储区在所述读取时刻所存储的第一数据;以及

根据所述第二数据对所述第一存储区的第一数据进行纠错,得到修正后的原始数据。

第二方面,本申请实施例提供一种数据处理装置,所述装置包括:

存储单元,用于获取原始数据并将所述原始数据存储到存储器中的第一存储区;

所述存储单元,还用于若所述原始数据的存储周期超过第一预设时长,则在所述原始数据存储周期内的任一中间时刻,读取所述第一存储区在所述中间时刻所存储的中间数据,并将所述中间数据存储到所述存储器中的第二存储区,其中,所述中间数据为所述原始数据在所述任一中间时刻在所述第一存储区的表现形式;以及

读取单元,用于在需要读取所述原始数据的读取时刻,读取所述第二存储区在所述读取时刻所存储的第二数据,并读取所述第一存储区在所述读取时刻所存储的第一数据;以及

纠错单元,用于根据所述第二数据对所述第一存储区的第一数据进行纠错,得到修正后的原始数据。

第三方面,本申请实施例提供了一种电子设备,包括处理器、存储器、通信接口以及一个或多个程序,其中,上述一个或多个程序被存储在上述存储器中,并且被配置由上述处理器执行,上述程序包括用于执行本申请实施例第一方面中的步骤的指令。

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