[发明专利]驱动电路、检测装置和检测装置的驱动方法有效

专利信息
申请号: 201910988840.6 申请日: 2019-10-17
公开(公告)号: CN110782819B 公开(公告)日: 2023-05-16
发明(设计)人: 贾鹏;王雷;王海生 申请(专利权)人: 京东方科技集团股份有限公司;北京京东方显示技术有限公司
主分类号: G09G3/00 分类号: G09G3/00;G01R31/00;G06V40/12
代理公司: 北京天昊联合知识产权代理有限公司 11112 代理人: 姜春咸;冯建基
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 驱动 电路 检测 装置 方法
【权利要求书】:

1.一种驱动电路,其特征在于,包括:

驱动模块,用于向检测区中的多行检测单元提供扫描信号,以使所述检测单元产生检测信号;所述检测区划分为沿列方向排列的多个检测子区,每个所述检测子区均设置有多行所述检测单元;

控制模块,用于在每个检测周期的初扫描阶段,控制所述驱动模块向每个所述检测子区中的部分行所述检测单元提供扫描信号,并根据所述检测单元的检测信号判断触控位置;在复扫描阶段,控制所述驱动模块向所述触控位置所在的所述检测子区中的每行所述检测单元依次输出扫描信号;

所述驱动模块包括:多组移位寄存单元,每组移位寄存单元包括级联的多个移位寄存单元,每组中的所述移位寄存单元包括至少一个第一移位寄存单元和至少一个第二移位寄存单元,每个移位寄存单元对应所述检测区中的一行检测单元,所述移位寄存单元用于向所述检测单元提供所述扫描信号;

所述控制模块包括:选通单元和控制单元;

除最后一组外,每组中的最后一个所述第一移位寄存单元的输出端与下一组中第一个所述第一移位寄存单元的输入端通过所述选通单元相连;所述选通单元用于:根据选通信号将与该选通单元相连的两个所述第一移位寄存单元导通,根据关断信号将与该选通单元相连的两个所述第一移位寄存单元断开;

所述控制单元用于在每个检测周期的初扫描阶段,向所述选通单元提供所述选通信号,并控制多个所述第一移位寄存单元依次输出扫描信号、控制所述第二移位寄存单元停止输出扫描信号;在每个检测周期的复扫描阶段,向所述选通单元提供所述关断信号,并根据所述检测单元的检测信号判断触控位置,控制所述触控位置所对应的一组移位寄存单元中的多个所述移位寄存单元依次输出扫描信号。

2.根据权利要求1所述的驱动电路,其特征在于,所述控制单元包括:

起始控制子单元,所述起始控制子单元与每组中的第一个所述第一移位寄存单元相连,所述起始控制子单元用于在所述初扫描阶段,向所述驱动模块中第一个所述第一移位寄存单元提供扫描起始信号;在所述复扫描阶段,向所述触控位置所对应的一组移位寄存单元中的第一个所述移位寄存单元提供扫描起始信号。

3.根据权利要求1所述的驱动电路,其特征在于,所述控制单元还包括:

第一时钟控制子单元,所述第一时钟控制子单元与每个所述第一移位寄存单元相连,所述第一时钟控制子单元用于在所述初扫描阶段,向每个所述第一移位寄存单元的时钟信号端提供第一时钟信号,以使多个所述第一移位寄存单元依次输出扫描信号;

第二时钟控制子单元,所述第二时钟控制子单元与每个所述移位寄存单元相连,所述第二时钟控制子单元用于在所述复扫描阶段,根据所述触控位置向相应组中的每个移位寄存单元的时钟信号端提供第二时钟信号,以使相应组中的每个所述移位寄存单元依次输出扫描信号。

4.根据权利要求3所述的驱动电路,其特征在于,每个所述移位寄存单元包括一个时钟信号端;

在初扫描阶段,所述第一时钟控制子单元向相邻两个所述第一移位寄存单元提供第一时钟信号的相位相反;

在复扫描阶段,所述第二时钟控制子单元向相邻两个移位寄存单元提供的第二时钟信号的相位相反。

5.根据权利要求1至4中任一项所述的驱动电路,其特征在于,所述选通单元包括选通晶体管,所述选通晶体管的栅极与所述控制单元相连,所述选通晶体管的第一极与所述第一移位寄存单元的输出端相连,所述选通晶体管的第二极与下一个所述第一移位寄存单元的输入端相连。

6.根据权利要求1至4中任一项所述的驱动电路,其特征在于,每组所述移位寄存单元中的所述第一移位寄存单元位于所述第二移位寄存单元之前。

7.根据权利要求1至4中任一项所述的驱动电路,其特征在于,每组所述移位寄存单元包括一个所述第一移位寄存单元和多个所述第二移位寄存单元。

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