[发明专利]利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法在审
申请号: | 201911000871.2 | 申请日: | 2019-10-21 |
公开(公告)号: | CN110634747A | 公开(公告)日: | 2019-12-31 |
发明(设计)人: | 郭慧;陈敦军;谢自力 | 申请(专利权)人: | 南京集芯光电技术研究院有限公司 |
主分类号: | H01L21/337 | 分类号: | H01L21/337;H01L29/808 |
代理公司: | 32332 江苏斐多律师事务所 | 代理人: | 张佳妮 |
地址: | 210008 江苏省南京市经济*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 再生长 单栅结构 刻蚀 结型场效应管 离子注入法 材料损伤 横向沟道 平面结构 器件结构 传统的 源漏区 栅区 离子 保留 | ||
1.一种利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其步骤包括:
(1)MOCVD法在衬底上生长半绝缘的GaN层,再生长n-GaN沟道层,接着生长重掺n+-GaN层;
(2)在外延片表面旋涂一层光刻胶,将图形转移到光刻胶上,然后以光刻胶作为掩膜,使用ICP刻蚀的方法在步骤(1)生长的器件结构上刻蚀重掺n+-GaN层,只保留源漏区的重掺n+-GaN,将中间栅区的重掺n+-GaN刻蚀掉;刻蚀深度至重掺n+-GaN层与n-GaN沟道层交界处,被刻蚀掉的区域呈现出贯穿重掺n+-GaN层的条状;
(3)MBE法在台面两侧通过掩模选区外延生长p-GaN,使得p-GaN填充在重掺n+-GaN层被刻蚀掉的区域,与n-GaN沟道层形成p-n结;
(4)使用电子束蒸镀的方法,在重掺n+-GaN层未被刻蚀的区域分别制作源电极和漏电极,在p-GaN上制作栅电极。
2.根据权利要求1所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:所述半绝缘GaN层厚度为3-5μm。
3.根据权利要求2所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:所述n-GaN沟道层厚度为50nm。
4.根据权利要求3所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:所述重掺n+-GaN层的厚度为80nm,掺杂浓度为5*1018-1*1019cm-3。
5.根据权利要求1-4中任一项所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:所述衬底为硅衬底、蓝宝石衬底或SiC衬底。
6.根据权利要求1-4中任一项所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:步骤(2)中所述被刻蚀掉的n+-GaN的长度为0.8-2μm,宽度为50-80μm。
7.根据权利要求6所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:步骤(3)中具体生长条件为:生长温度为700-800℃,在富Ga生长的条件下进行Mg掺杂,掺杂浓度1*1019cm-3,其高度与n-GaN沟道层齐平或略高于重掺n+-GaN层,高度差在10nm以下。
8.根据权利要求7所述的利用MBE再生长p-GaN的单栅结构GaN-JFET器件的方法,其特征在于:步骤(4)中所述源电极和漏电极为Ti/Al/Ni/Au多层金属,厚度为30/150/50/100nm,栅电极为Ni/Au多层金属,厚度为50/100nm。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造