[发明专利]3D存储器件及其制造方法在审
申请号: | 201911009853.0 | 申请日: | 2019-10-23 |
公开(公告)号: | CN110649032A | 公开(公告)日: | 2020-01-03 |
发明(设计)人: | 刘思敏;杨川;严龙翔;吴智鹏;许波;彭爽爽;谢柳群;殷姿;刘力恒 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11563 | 分类号: | H01L27/11563;H01L27/11578;H01L27/11568 |
代理公司: | 11449 北京成创同维知识产权代理有限公司 | 代理人: | 蔡纯 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 存储器件 通道孔 掺杂区 衬底 栅叠层结构 掺杂 连续调节 杂质原子 芯部 层间绝缘层 掺杂多晶硅 第一导电层 表面翘曲 交替堆叠 晶圆翘曲 浓度杂质 栅极导体 掺杂的 中芯部 沟道 晶圆 内壁 翘曲 栅线 贯穿 覆盖 申请 制造 | ||
1.一种3D存储器件,包括:
衬底;
栅叠层结构,位于所述衬底上方,包括交替堆叠的多个栅极导体和多个层间绝缘层;
多个沟道柱和多个通道孔,贯穿所述栅叠层结构;
掺杂区,位于所述通道孔底部且形成于所述衬底内;
第一导电层,覆盖所述通道孔的内壁并与所述掺杂区接触;以及
芯部,位于所述通道孔内部以及所述掺杂区的上方,
其中,所述芯部为掺杂了一定浓度杂质原子的掺杂多晶硅,调节所述杂质原子的掺杂浓度以实现对所述3D存储器件的表面翘曲程度的连续调节。
2.根据权利要求1所述的3D存储器件,其中,所述杂质原子为氮原子、磷原子和砷原子中的一个或者多个。
3.根据权利要求1所述的3D存储器件,其中,所述杂质原子的掺杂浓度与所述3D存储器件的表面翘曲程度呈线性关系。
4.根据权利要求1所述的3D存储器件,其中,所述3D存储器件还包括:
复合沉积层,位于所述第一导电层与所述芯部之间,覆盖所述第一导电层的部分表面,且包覆所述芯部的侧壁。
5.根据权利要求4所述的3D存储器件,其中,所述复合沉积层包括种子层和作为硅基的乙硅烷层。
6.根据权利要求1所述的3D存储器件,其中,所述3D存储器件还包括:
导电柱,位于所述通道孔内以及所述芯部的上方;以及
第二导电层,至少覆盖所述导电柱的侧壁,且与所述第一导电层直接触,从而与所述掺杂区形成电连接。
7.根据权利要求6所述的3D存储器件,其中,所述第二导电层还位于所述芯部和所述导电柱之间。
8.根据权利要求6所述的3D存储器件,其中,
所述第一导电层包括由第一导电材料形成的第一材料层和由第二导电材料形成的第二材料层;
所述第二导电层包括由第一导电材料形成的第三材料层和由第二导电材料形成的第四材料层。
9.根据权利要求8所述的3D存储器件,其中,所述第一导电材料为钛,所述第二导电材料为氮化钛,所述导电柱的材料包括钨。
10.一种3D存储器件的制造方法,包括:
在衬底上形成栅叠层结构,所述栅叠层结构包括交替堆叠的多个栅极导体层与多个层间绝缘层;
形成贯穿所述栅叠层结构的多个沟道柱和多个通道孔;
在所述通道孔底部及所述衬底内部形成具有暴露表面的掺杂区;
形成覆盖所述通道孔的内壁且与所述掺杂区接触的第一导电层;以及
在所述通道孔内以及所述掺杂区的上方形成芯部,
其中,所述芯部为掺杂了一定浓度的杂质原子的掺杂多晶硅,调节所述杂质原子的掺杂浓度以实现对所述3D存储器件的表面翘曲程度的连续调节。
11.根据权利要求10所述的制造方法,其中,所述杂质原子为氮原子、磷原子和砷原子中的一个或者多个。
12.根据权利要求10所述的制造方法,其中,所述杂质原子的掺杂浓度与所述3D存储器件的表面翘曲程度呈线性关系。
13.根据权利要求10所述的制造方法,其中,还包括:形成位于所述第一导电层与所述芯部之间,覆盖所述第一导电层的部分表面,且包覆所述芯部的侧壁的复合沉积层。
14.根据权利要求13所述的制造方法,其中,所述复合沉积层包括种子层和作为硅基的乙硅烷层。
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H01L 半导体器件;其他类目中不包括的电固体器件
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H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
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