[发明专利]具有高速缓存系统的存储系统有效
申请号: | 201911087204.2 | 申请日: | 2019-11-08 |
公开(公告)号: | CN111190836B | 公开(公告)日: | 2023-08-29 |
发明(设计)人: | 郑承奎;徐镇雄;权正贤 | 申请(专利权)人: | 爱思开海力士有限公司 |
主分类号: | G06F12/0868 | 分类号: | G06F12/0868 |
代理公司: | 北京弘权知识产权代理有限公司 11363 | 代理人: | 许伟群;郭放 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 高速缓存 系统 存储系统 | ||
本申请公开了具有高速缓存系统的存储系统。该存储系统包括主机控制器和高速缓存系统。主机控制器包括主机队列,包括从主机输出的命令的主机数据被储存在所述主机队列中。该高速缓存系统包括具有多个组的高速缓冲存储器和控制高速缓冲存储器的操作的高速缓存控制器。高速缓存控制器向主机控制器传送与多个组之中的主机数据要被传送至的特定组有关的状态信息。主机控制器从高速缓存控制器接收所述状态信息,以确定储存在主机队列中的主机数据至高速缓存系统的传输或不传输。
相关申请的交叉引用
本申请要求2018年11月14日提交的申请号为10-2018-0140299的韩国申请的优先权,其公开内容通过引用整体合并于此。
技术领域
本公开的各种实施例涉及存储系统,并且更具体地,涉及具有高速缓存系统的存储系统以及控制该存储系统中的高速缓存操作的方法。
背景技术
在存储系统中,与诸如中央处理单元(CPU)之类的主机相比,存储器通常以相对较低的速度运行。因此,包括高速缓冲存储器的高速缓存系统已经在大多数存储系统中被广泛采用以解决由于主机与存储器之间的速度差异而引起的问题。高速缓存系统可以设置在主机(或主机控制器)与存储器之间,或者可以设置在主机与存储器之间的存储器控制器中。如果存储系统采用完全关联的高速缓存架构,则即使高速缓冲存储器中构成一个组的所有块都填充数据,也可以在数据传输中使用高速缓冲存储器中的另一个组中的空块。相反,如果存储系统采用组关联的高速缓存架构并且在高速缓冲存储器中构成特定组的所有块都填充数据,则从主机朝向高速缓冲存储器的数据传输可能会中断,直到该特定组中所包括的任何一个块中储存的数据被移除为止。这可能导致存储系统性能下降。
发明内容
根据本公开的实施例,一种存储系统包括主机控制器,所述主机控制器包括主机队列,其中主机队列被配置为储存从主机接收到的主机数据,并且其中,主机数据包括命令。所述存储系统还包括高速缓存系统,其包括高速缓冲存储器和高速缓存控制器,其中高速缓存控制器被配置为控制高速缓冲存储器的操作,并且其中,高速缓冲存储器包括多个组。所述高速缓存控制器还被配置为向主机控制器传送与多个组中的主机数据中的第一主机数据要被传送至的第一组有关的第一状态信息。主机控制器被配置为从高速缓存控制器接收第一状态信息,并基于第一状态信息来确定是否将储存在主机队列中的第一主机数据传送给高速缓存系统。
根据本公开的另一实施例,一种存储系统,包括主机、存储器以及耦接在主机与存储器之间以控制存储器的操作的存储器控制器。所述存储器控制器包括:主机队列,其被配置为储存包括从主机输出的命令的主机数据;主机队列管理逻辑单元,其被配置为控制用于传送主机队列中所储存的主机数据的操作;以及高速缓存系统,其包括具有多个组的高速缓冲存储器和控制高速缓冲存储器的操作的高速缓存控制器。高速缓存控制器向主机队列管理逻辑单元传送与多个组之中的主机数据要被传送至的特定组有关的状态信息。主机队列管理逻辑单元从高速缓存控制器接收所述状态信息,以确定是否把储存在主机队列中的主机数据传送给高速缓存系统。
根据本公开的另一实施例,一种用于控制存储系统中的高速缓存操作的方法,所述存储系统包括:主机队列,其被配置为储存包括从主机输出的命令的主机数据;和高速缓冲存储器,其包括多个组。具有组关联高速缓存架构的所述高速缓冲存储器还包括多个路,其中多个路中的每个路均包括多个块,其中多个组中的每个组均包括来自每个路中的单个块。所述方法包括:提供与构成高速缓冲存储器的多个组之中的主机数据要被传送至的特定组有关的状态信息,以及根据所述状态信息来确定储存在主机队列中的主机数据至高速缓冲存储器的传输或不传输。
附图说明
参考附图通过各种实施例说明了所公开技术的某些特征,其中:
图1是示出根据本公开的实施例的存储系统的框图。
图2是示出图1的存储系统中所包括的主机队列的示例的示意图。
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