[发明专利]通讯系统、通讯方法以及媒体存取控制电路在审
申请号: | 201911293599.1 | 申请日: | 2019-12-16 |
公开(公告)号: | CN112994722A | 公开(公告)日: | 2021-06-18 |
发明(设计)人: | 郭乃彰 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | H04B1/40 | 分类号: | H04B1/40;H04L29/10 |
代理公司: | 中国贸促会专利商标事务所有限公司 11038 | 代理人: | 张丹 |
地址: | 中国台湾新竹*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 通讯 系统 方法 以及 媒体 存取 控制电路 | ||
本公开涉及通讯系统、通讯方法以及媒体存取控制电路。一种通讯系统包含一媒体存取控制电路以及至少一物理层电路。至少一物理层电路耦接媒体存取控制电路。媒体存取控制电路透过一串行化/反串行化(SERDES)接口发送一控制命令至至少一物理层电路。响应于控制命令,至少一物理层电路透过串行化/反串行化接口回传一物理层数据至媒体存取控制电路。
技术领域
本公开中所述实施例内容是有关于一种通讯技术,特别关于一种通讯系统、通讯方法以及媒体存取控制电路。
背景技术
随着科技的发展,各式电子装置已被应用于许多领域。而两个电子装置之间则可藉由通讯技术进行讯号传输。
在一些相关技术的通讯系统中,媒体存取控制(medium access control,MAC)电路与物理层(physical layer)电路会透过多种通讯接口进行沟通。然而,这样的方式会有讯号干扰以及成本高的问题。
发明内容
本公开的一些实施方式是关于一种通讯系统。通讯系统包含一媒体存取控制电路以及至少一物理层电路。至少一物理层电路耦接媒体存取控制电路。媒体存取控制电路透过一串行化/反串行化接口发送一控制命令至至少一物理层电路。响应于控制命令,至少一物理层电路透过串行化/反串行化接口回传一物理层数据至媒体存取控制电路。
本公开的一些实施方式是关于一种通讯方法。通讯方法包含:藉由一媒体存取控制电路透过一串行化/反串行化接口发送一控制命令至至少一物理层电路;以及响应于控制命令,藉由至少一物理层电路透过串行化/反串行化接口回传一物理层数据至媒体存取控制电路。
本公开的一些实施方式是关于一种媒体存取控制电路。媒体存取控制电路耦接至少一物理层电路。媒体存取控制电路用以透过一串行化/反串行化接口发送一控制命令至至少一物理层电路。响应于控制命令,媒体存取控制电路更用以透过串行化/反串行化接口接收来自至少一物理层电路的一物理层数据。
综上所述,本公开的通讯系统、通讯方法以及媒体存取控制电路,可维持讯号的完整性且降低成本。
附图说明
为让本公开的上述和其他目的、特征、优点与实施例能够更明显易懂,所附图式的说明如下:
图1是依照本公开一些实施例所绘示的一通讯系统的示意图;
图2是依照本公开一些实施例所绘示的封包串的示意图;以及
图3是依照本公开一些实施例所绘示的一通讯方法的流程图。
具体实施方式
以下将以图式揭露本公开的复数个实施方式,为明确说明起见,许多实务上的细节将在以下叙述中一并说明。然而,应了解到,这些实务上的细节不应用以限制本公开。也就是说,在本公开部分实施方式中,这些实务上的细节是非必要的。此外,为简化图式起见,一些习知惯用的结构与元件在图式中将以简单示意的方式绘示之。
本文中所使用的『包含』、『包括』、『具有』及相似词汇,指明其所记载的特征、区域、整数、步骤、操作、元件与/或组件,但不排除其所述或额外的其一个或多个其它特征、区域、整数、步骤、操作、元件、组件,与/或其中的群组。
在本文中所使用的用词『耦接』亦可指『电性耦接』,且用词『连接』亦可指『电性连接』。『耦接』及『连接』亦可指二个或多个组件相互配合或相互互动。
参考图1。图1是依照本公开一些实施例所绘示的通讯系统100的示意图。在一些实施例中,通讯系统100是应用于网络交换器系统中,但本公开不以此为限。各种应用皆在本公开的范围内。
通讯系统100包含媒体存取控制(medium access control,MAC)电路120及至少一物理层(physical layer)电路140。以图1示例而言,通讯系统100包含复数的(六个)物理层电路140。
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