[发明专利]神经网络处理器板卡及相关产品在审
申请号: | 201911333469.6 | 申请日: | 2017-12-14 |
公开(公告)号: | CN110826712A | 公开(公告)日: | 2020-02-21 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 中科寒武纪科技股份有限公司 |
主分类号: | G06N3/063 | 分类号: | G06N3/063 |
代理公司: | 广州三环专利商标代理有限公司 44202 | 代理人: | 熊永强 |
地址: | 100190 北京市海*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 神经网络 处理器 板卡 相关 产品 | ||
1.一种神经网络处理器板卡,其特征在于,所述神经网络处理器板卡包括:神经网络芯片封装结构、第一电气及非电气连接装置和第一基板;所述神经网络芯片封装结构包括:神经网络芯片、第二电气及非电气连接装置和第二基板,所述第二基板承载所述神经网络芯片,所述第二基板通过所述第二电气及非电气连接装置与所述神经网络芯片连接;
所述神经网络芯片:主处理电路以及多个基础处理电路;所述主处理电路或多个基础处理电路中至少一个电路包括:数据类型运算电路;所述数据类型运算电路,用于执行浮点类型数据与定点类型数据之间的转换;所述主处理电路通过所述第二电气及非电气连接装置与所述第二基板连接;
所述多个基础处理电路呈阵列分布;每个基础处理电路与相邻的其他基础处理电路连接,所述主处理电路连接第1行的n个基础处理电路、第m行的n个基础处理电路以及第1列的m个基础处理电路;
所述主处理电路,用于执行神经网络运算中的各个连续的运算以及和与其相连的所述基础处理电路传输数据;
所述多个基础处理电路,用于依据传输的数据以并行方式执行神经网络中的运算,并将运算结果通过与所述主处理电路连接的基础处理电路传输给所述主处理电路。
2.根据权利要求1所述的神经网络处理器板卡,其特征在于,
所述神经网络芯片封装结构还包括:焊盘、焊球,补强结构,所述第二基板包括:连接点和引脚;
所述焊盘与所述神经网络芯片连接,所述焊球形成于所述焊盘与所述第二基板的连接点之间;所述引脚与所述第一基板相连,实现外部数据和内部数据的传输;所述补强结构与焊盘连接,所述补强结构内埋于所述焊球中。
3.根据权利要求2所述的神经网络处理器板卡,其特征在于,所述第二基板还包括:绝缘填充物、散热膏和金属外壳散热片;所述散热膏和所述金属外壳散热片用于散发所述神经网络芯片运行时的热量。
4.根据权利要求1-3任意一项所述的神经网络处理器板卡,其特征在于,所述第一基板还包括:快速外部设备互连总线接口、小封装可热插拔接口、以太网接口或控制器局域网总线接口。
5.根据权利要求1-3任意一项所述的神经网络处理器板卡,其特征在于,所述神经网络芯片封装结构的封装结构为下述封装的任意一种:
倒装芯片球栅阵列封装、薄型四方扁平式封装、带散热器的四方扁平封装、无引脚四方扁平封装、小间距四方扁平式封装。
6.根据权利要求1所述的神经网络处理器板卡,其特征在于,
所述主处理电路,用于获取待计算的数据块以及运算指令,通过所述数据类型运算电路将所述待计算的数据块转换成定点类型的数据块,依据该运算指令对所述定点类型的待计算的数据块划分成分发数据块以及广播数据块;对所述分发数据块进行拆分处理得到多个基本数据块,将所述多个基本数据块分发至与其连接的基础处理电路,将所述广播数据块广播至与其连接的基础处理电路;
所述基础处理电路,用于对所述基本数据块与所述广播数据块以定点数据类型执行内积运算得到运算结果,将所述运算结果发送至所述主处理电路;
或将所述基本数据块与所述广播数据块转发给其他基础处理电路以定点数据类型执行内积运算得到运算结果,将所述运算结果发送至所述主处理电路;
所述主处理电路,用于通过所述数据类型运算电路将对所述运算结果转换成浮点类型数据,将浮点类型数据处理得到所述待计算的数据块以及运算指令的指令结果;
所述主处理电路,具体用于将所述广播数据块通过一次广播发送至与其连接的所述基础处理电路;
所述基础处理电路,具体用于将所述基本数据块与所述广播数据块以定点数据类型执行内积处理得到内积处理结果,将所述内积处理结果累加得到运算结果,将所述运算结果发送至所述主处理电路;
所述主处理电路,用于在如果所述运算结果为内积处理的结果时,对所述运算结果累加后得到累加结果,将该累加结果排列得到所述待计算的数据块以及运算指令的指令结果。
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