[发明专利]一种数字锁相环频率合成器在审

专利信息
申请号: 201911371890.6 申请日: 2019-12-26
公开(公告)号: CN111010168A 公开(公告)日: 2020-04-14
发明(设计)人: 陈晓飞;丁鹤;唐敔翔;李钰莹;汪洋 申请(专利权)人: 华中科技大学
主分类号: H03L7/08 分类号: H03L7/08;H03L7/087;H03L7/099;H03L7/18
代理公司: 北京科亿知识产权代理事务所(普通合伙) 11350 代理人: 汤东凤
地址: 430074 湖北*** 国省代码: 湖北;42
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摘要:
搜索关键词: 一种 数字 锁相环 频率 合成器
【权利要求书】:

1.一种数字锁相环频率合成器,其特征在于:鉴频鉴相器PFD将输入参考频率信号FREF与分频器的输出频率信号Fdiv的相位差转化为UP、DN信号,然后UP、DN信号经过门电路处理后,输出两个不同脉宽的方波信号到斐波那契数列时间数字转换器TDC模块;相位差信号经过TDC模块转化为对应的数字信号,并输出表示相位差正负的符号位;数字滤波器采用比例积分控制器,比例系数与积分系数的比值决定数字滤波器的零点;TDC输出的数字信号去控制数字控制振荡器模块,调整输出频率。

2.根据权利要求1所述的数字锁相环频率合成器,其特征在于:TDC模块由D触发器和延时单元构成,所述TDC模块采用非恒定分辨率结构,大幅减少检测特定相位差信号范围所需要的D触发器和延时单元个数。

3.根据权利要求2所述的数字锁相环频率合成器,其特征在于:所述D触发器的输出分别乘以相应的斐波那契系数fn,n=1…t,t的取值取决于输入参考频率和输出频率要求,输入检测脉宽从0逐渐增大,TDC的增益逐渐变大,等效分辨率ΔTDCe逐渐变高,环路单位增益带宽逐渐变大;延时单元分别乘以延时时间系数Kn,Kn将fn与二进制数列相结合,使得D触发器直接输出二进制数字信号,不需要译码器电路,即令fn是斐波那契系数,n=1…t,t的取值取决于输入参考频率和输出频率要求。

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