[发明专利]基于PCIe总线的FPGA并行升级方法、装置、介质及电子设备有效

专利信息
申请号: 201911383362.2 申请日: 2019-12-28
公开(公告)号: CN113050976B 公开(公告)日: 2023-06-20
发明(设计)人: 何先铃 申请(专利权)人: 浙江宇视科技有限公司
主分类号: G06F8/656 分类号: G06F8/656
代理公司: 北京品源专利代理有限公司 11332 代理人: 孟金喆
地址: 310051 浙江省杭州市滨江区西兴街道江陵路*** 国省代码: 浙江;33
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摘要:
搜索关键词: 基于 pcie 总线 fpga 并行 升级 方法 装置 介质 电子设备
【权利要求书】:

1.一种基于PCIe总线的FPGA并行升级方法,其特征在于,包括:

若检测到FPGA升级事件,确定升级文件,并对所述升级文件的头部校验数据进行校验,确定校验成功升级文件对应的FPGA为目标FPGA;

根据所述目标FPGA的FPGA类型划分多播组,并根据目标FPGA在PCIe总线上的位置信息创建多播组;

向所述多播组下发升级文件,供多播组中待升级的FPGA进行并行升级;

其中,所述向所述多播组下发升级文件,供多播组中待升级的FPGA进行并行升级,包括:

根据多播组数量,确定升级文件的分片个数,得到升级文件单片,在FPGA内部开辟一块固定大小的FIFO空间供升级文件传输,在CPU侧需将待升级的文件切割为大小小于等于FIFO的多片数据;每次将切割后的单片文件发送到FPGA的FIFO中,FPGA检测此FIFO有数据写入后立即将FIFO中的数据写入到外部flash中;将升级文件单片下发到多播组,若当前多播组内所有待升级的FPGA的升级状态均正常,则下发下一个升级文件单片,直至升级文件写入完成;所述FPGA在将所述升级文件单片写入后对自身内部升级状态寄存器进行置位;所述升级状态正常为所述待升级的FPGA的内部升级状态寄存器在超时时间内被检测出置位;

所述对所述升级文件的头部校验数据进行校验,包括:

导入原始升级文件,在原始升级文件的头部增加预设长度的校验码,以得到升级文件;其中,所述校验码包括设备类型和FPGA类型;

对所述预设长度的校验码进行校验。

2.根据权利要求1所述的方法,其特征在于,所述校验码还包括主版本号和次版本号;

相应的,对所述预设长度的校验码进行校验,包括:

若对所述设备类型和FPGA类型校验成功,且当前升级为强制升级,则在所述主版本号和次版本号满足预设标准时,则确定通过校验。

3.根据权利要求1所述的方法,其特征在于,在根据目标FPGA在PCIe总线上的位置信息创建多播组之前,所述方法还包括:

获取目标FPGA映射到PCIe交换芯片上的端口信息。

4.根据权利要求3所述的方法,其特征在于,升级文件写入完成,包括:

将所有升级文件单片下发到多播组,供所述待升级的FPGA将所述升级文件写入到flash,并将待升级的FPGA的状态寄存器置位到升级状态。

5.根据权利要求4所述的方法,其特征在于,所述方法还包括:

若检测到待升级的FPGA状态寄存器复位,则确定所述待升级的FPGA升级完成;

通过所述flash的正常升级分区启动升级后的FPGA,若启动失败,则从所述flash的备份分区启动升级失败的FPGA。

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