[发明专利]具有动态ECC电压和频率的方法和系统在审

专利信息
申请号: 201911398333.3 申请日: 2019-12-30
公开(公告)号: CN111382002A 公开(公告)日: 2020-07-07
发明(设计)人: J·S·帕里;N·格勒斯;D·A·帕尔默;C·M·于伦斯科格 申请(专利权)人: 美光科技公司
主分类号: G06F11/10 分类号: G06F11/10;G11C29/42
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 具有 动态 ecc 电压 频率 方法 系统
【说明书】:

本申请涉及具有动态ECC电压和频率的方法和系统。公开了设备和方法,包括使用存储器控制器来监控与主机装置的主机处理器的功率电平相关的至少一个参数,以及基于所述至少一个参数来动态调整所述存储器控制器的纠错码ECC子系统的时钟频率和电压电平中的至少一个,以控制所述主机装置的功率使用。

技术领域

本申请涉及存储器装置,尤其涉及具有动态ECC电压和频率的方法和系统。

背景技术

存储器装置是为主机系统(例如,计算机或其它电子装置)提供数据电子存储的半导体电路。存储器装置可以是易失性或非易失性的。易失性存储器需要电源来维护数据,并且包括诸如随机存取存储器(RAM)、静态随机存取存储器(SRAM)、动态随机存取存储器(DRAM)或同步动态随机存取存储器(SDRAM)的装置等。非易失性存储器在未通电时可以保留存储的数据,并且包括闪存、只读存储器(ROM)、电可擦除可编程只读存储器(EEPROM)、可擦除可编程只读存储器(EPROM)、电阻可变存储器,诸如相变随机存取存储器(PCRAM)、电阻随机存取存储器(RRAM)或磁阻随机存取存储器(MRAM)等。

主机系统通常包括主处理器、支持主处理器的第一数量的主存储器(例如,通常是易失性存储器,诸如DRAM)以及一或多个存储系统(例如,通常是非易失性存储器,诸如闪存),其提供附加存储以保留除主存储器之外的数据或与主存储器分离的数据。

诸如固态硬盘(SSD)的存储系统可以包括存储器控制器和一或多个存储器装置,包括多个管芯或逻辑单元(LUN)。在某些示例中,每个管芯可以包括多个存储器阵列和其上的外围电路系统,诸如管芯逻辑或管芯处理器。存储器控制器可以包括被配置为通过通信接口(例如,双向并行或串行通信接口)与主机装置(例如,主机处理器或接口电路系统)通信的接口电路系统。存储器控制器可以从主机系统接收与存储器操作或指令相关联的命令或操作,诸如在存储器装置和主机装置之间传输数据(例如,用户数据和相关联的完整性数据,诸如错误数据或地址数据等)的读或写操作,从存储器装置擦除数据的擦除操作,执行驱动器管理操作(例如,数据迁移、垃圾收集、块报废)等。

发明内容

本发明的一个方面提供一种存储系统,其中所述存储系统包括:存储器阵列;和存储器控制器,被配置为与主机装置的主机处理器通信,其中所述存储器控制器被编程为执行操作,所述操作包括:监控与所述主机处理器的功率电平相关的至少一个参数;以及基于所述至少一个参数动态调整所述存储器控制器的纠错码(ECC)子系统的时钟频率和电压电平中的至少一个,以控制所述主机装置的功率使用。

本公开的另一个方面提供一种方法,其中所述方法包括:由存储器控制器监控与被配置为与所述存储器控制器通信的主机装置的主机处理器的功率电平相关的至少一个参数;以及由所述存储器控制器基于所述至少一个参数动态调整所述存储器控制器的纠错码(ECC)子系统的时钟频率和电压电平中的至少一个,以控制所述主机装置的功率使用。

本公开的另一个方面提供一种非暂时性计算机可读存储介质,其中所述非暂时性计算机可读存储介质包括其上的指令,当由处理器执行时,所述指令使得所述处理器执行操作,所述操作包括:监控与被配置为与所述处理器通信的主机装置的主机处理器的功率电平相关的至少一个参数;以及基于所述至少一个参数动态调整纠错码(ECC)子系统的时钟频率和电压电平中的至少一个,以控制所述主机装置的功率使用。

附图说明

在不一定按比例绘制的附图中,相同的数字可在不同的视图中描述类似的部件。具有不同字母后缀的相同数字可表示类似部件的不同示例。作为示例,附图通常以非限制方式说明本文件中讨论的各种实施例。

图1示出了包括主机装置和存储系统的示例主机系统。

图2示出了动态调整纠错码(ECC)电压和频率的示例方法。

图3A示出了主机装置基于用于处理的带宽的功率使用的示例。

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