[发明专利]用于图形处理命令的压缩的方法和装置在审
申请号: | 201911411406.8 | 申请日: | 2019-12-31 |
公开(公告)号: | CN113129201A | 公开(公告)日: | 2021-07-16 |
发明(设计)人: | 王卫汉;何杰 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06T1/20 | 分类号: | G06T1/20;G06F9/30 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈依心;黄嵩泉 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 图形 处理 命令 压缩 方法 装置 | ||
实施例总体上涉及用于图形处理命令的压缩的方法和装置。用于数据处理的方法的实施例包括:捕获包括顶点数据的第一图形处理命令;构建具有来自顶点数据的多个数据向量的数据数组;确定数据数组是否具有特定数据类型;响应于数据数组具有特定数据类型,确定数据数组的语义属性是否为颜色;以及响应于语义属性为颜色,确定多个数据向量中的彼此不同的多个代表数据向量;构建具有多个调色板向量的调色板数组,多个调色板向量各自包含多个代表数据向量中的对应一个代表数据向量的数据元素以及调色板向量标识符;以及通过将数据数组替换为调色板数组和调色板向量标识符的序列来生成经修改的第一图形处理命令。
技术领域
实施例总体上涉及数据处理,并且更具体地涉及对图形处理命令的数据处理。
背景技术
当前的并行图形数据处理包括被开发为用于对图形数据执行特定操作的系统和方法,这些特定操作诸如例如,线性插值、曲面细分、栅格化、纹理映射、深度测试等。传统上,图形处理器使用固定功能计算单元来处理图形数据;然而,最近,图形处理器的多个部分已经变得可编程,使得此类处理器能够支持用于处理顶点和片段数据的更广泛种类的操作。
为了进一步提高性能,图形处理器典型地实现诸如流水线操作之类的处理技术,这些处理技术尝试贯穿图形流水线的不同部分并行地处理尽可能多的图形数据。具有单指令多线程(SIMT)架构的并行图形处理器被设计成使图形流水线中的并行处理的量最大化。在SIMT架构中,成组的并行线程尝试尽可能频繁地一起同步地执行程序指令,以提高处理效率。可以在Shane Cook的CUDA编程(CUDA Programming)第三章,第37-51页(2013年)中找到对SIMT架构的软件和硬件的总体概述。
附图说明
为了以能够详细理解本实施例的以上记载特征的方式,可通过参考实施例来对以上简要概括的实施例进行更具体的描述,这些实施例中的一些在所附附图中被图示。然而,应当注意,所附附图仅图示出典型实施例,并且因此不应被认为是对其范围的限制。
图1是根据实施例的处理系统的框图;
图2A-图2D图示由本文中描述的实施例提供的计算系统和图形处理器;
图3A-图3C图示由本文中描述的实施例提供的附加的图形处理器和计算加速器架构的框图;
图4是根据一些实施例的图形处理器的图形处理引擎的框图;
图5A-图5B图示根据本文中描述的实施例的包括在图形处理器核中采用的处理元件阵列的线程执行逻辑;
图6图示根据实施例的附加的执行单元;
图7是图示根据一些实施例的图形处理器指令格式的框图;
图8是图形处理器的另一个实施例的框图;
图9A-图9B图示根据一些实施例的图形处理器命令格式和命令序列;
图10图示根据一些实施例的用于数据处理系统的示例性图形软件架构;
图11A是图示根据实施例的IP核开发系统的框图;
图11B图示根据本文中描述的一些实施例的集成电路封装组件的横截面侧视图;
图11C图示封装组件,该封装组件包括连接到衬底的多个单元的硬件逻辑小芯片(例如,基础管芯);
图11D图示根据实施例的包括可互换小芯片的封装组件;
图12是图示根据实施例的示例性芯片上系统集成电路的框图;
图13A-图13B是图示根据本文中所描述的实施例的用于在SoC内使用的示例性图形处理器的框图;
图14是根据实施例的处理系统的框图;
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