[实用新型]一种隔离电路有效
申请号: | 201920867483.3 | 申请日: | 2019-06-11 |
公开(公告)号: | CN209787152U | 公开(公告)日: | 2019-12-13 |
发明(设计)人: | 徐群 | 申请(专利权)人: | 深圳市红芯微科技开发有限公司 |
主分类号: | H03K19/0175 | 分类号: | H03K19/0175 |
代理公司: | 31332 上海互顺专利代理事务所(普通合伙) | 代理人: | 韦志刚 |
地址: | 518116 广东省深圳市龙岗区龙城*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 隔离电容 放大器 采样电阻 隔离电路 第二管 锁存器 本实用新型 输入端连接 接地端 管芯 一端接收 接地 高隔离 输出端 共地 | ||
1.一种隔离电路,其特征在于,所述隔离电路包括隔离电容模块、第一采样电阻、第一放大器、锁存器,所述第一采样电阻、第一放大器、锁存器位于第二管芯,所述隔离电容模块一端接收输入信号,所述隔离电容模块的另一端与第一采样电阻的一端、第一放大器的输入端连接,所述第一放大器的输出端与锁存器的输入端连接,所述第一采样电阻的另一端接地,所述隔离电容模块包括一个或多个隔离电容,所述隔离电容模块位于第一管芯和/或第二管芯,所述第一管芯的接地端与第二管芯的接地端不共地。
2.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电容一端位于第一管芯,另一端位于第二管芯。
3.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻,所述第二采样电阻位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容组成,所述第一隔离电容、第二隔离电容均位于第一管芯或第二管芯,所述第一采样电阻一端与第一隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第二隔离电容、第一放大器的另一个输入端连接,所述第二采样电阻的另一端接地。
4.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻,所述第二采样电阻位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容组成,所述第一隔离电容、第二隔离电容一端位于第一管芯,所述第一隔离电容、第二隔离电容另一端位于第二管芯,所述第一采样电阻一端与第一隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第二隔离电容、第一放大器的另一个输入端连接,所述第二采样电阻的另一端接地。
5.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻,所述第二采样电阻位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容、第三隔离电容、第四隔离电容组成,所述第一隔离电容、第二隔离电容位于第一管芯,所述第三隔离电容、第四隔离电容位于第二管芯,所述第一隔离电容与第三隔离电容串联连接,所述第二隔离电容与第四隔离电容串联连接,所述第一采样电阻一端与第三隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第四隔离电容、第一放大器的另一个输入端连接,所述第二采样电阻的另一端接地。
6.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻、第二放大器,所述第二采样电阻、第二放大器位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容组成,所述第一隔离电容、第二隔离电容均位于第一管芯或第二管芯,所述第一采样电阻一端与第一隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第二隔离电容、第二放大器的输入端连接,所述第二采样电阻的另一端接地,所述第二放大器的输出端与锁存器的另一个输入端连接。
7.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻、第二放大器,所述第二采样电阻、第二放大器位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容组成,所述第一隔离电容、第二隔离电容一端位于第一管芯,所述第一隔离电容、第二隔离电容另一端位于第二管芯,所述第一采样电阻一端与第一隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第二隔离电容、第二放大器的输入端连接,所述第二采样电阻的另一端接地,所述第二放大器的输出端与锁存器的另一个输入端连接。
8.根据权利要求1所述的一种隔离电路,其特征在于,所述隔离电路还包括第二采样电阻、第二放大器,所述第二采样电阻、第二放大器位于第二管芯,所述隔离电容模块由第一隔离电容、第二隔离电容、第三隔离电容、第四隔离电容组成,所述第一隔离电容、第二隔离电容位于第一管芯,所述第三隔离电容、第四隔离电容位于第二管芯,所述第一隔离电容与第三隔离电容串联连接,所述第二隔离电容与第四隔离电容串联连接,所述第一采样电阻一端与第三隔离电容、第一放大器的输入端连接,所述第二采样电阻一端与第四隔离电容、第二放大器的输入端连接,所述第二采样电阻的另一端接地,所述第二放大器的输出端与锁存器的另一个输入端连接。
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