[实用新型]一种宽电压多通道数字IO系统有效
| 申请号： | 201921160436.1 | 申请日： | 2019-07-23 |
| 公开（公告）号： | CN210742351U | 公开（公告）日： | 2020-06-12 |
| 发明（设计）人： | 唐起源;章宁;曾垒;彭雪娟 | 申请（专利权）人： | 国营芜湖机械厂 |
| 主分类号： | G01R1/28 | 分类号： | G01R1/28;G01R31/317;G05B19/042 |
| 代理公司： | 北京汇信合知识产权代理有限公司 11335 | 代理人： | 朱昱 |
| 地址： | 24100*** | 国省代码： | 安徽;34 |
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| 摘要： | |||
| 搜索关键词： | 一种 电压 通道 数字 io 系统 | ||
1.一种宽电压多通道数字IO系统，其特征在于：包括FPGA电路(1)、驱动级电路、对外接口(2)、与FPGA电路(1)连接的总线接口(3)、SDRAM电路(4)、时针电路(5)、DSS电路(6)以及系统电源(7)，所述驱动级电路连接有与待测电路板的逻辑电源相连的驱动电源(8),所述驱动级电路包括均与FPGA电路(1)、对外接口(2)相连的驱动电路(9)、比较电路(10)以及由两个电阻和一个运算放大器所组成的基准产生电路(11)。
2.根据权利要求1所述的一种宽电压多通道数字IO系统，其特征在于：所述驱动电路(9)由宽电压高速驱动器组成，所述宽电压高速驱动器的逻辑输入、使能信号均与FPGA电路(1)连接，输出与对外接口(2)连接。
3.根据权利要求2所述的一种宽电压多通道数字IO系统，其特征在于：所述宽电压高速驱动器的输出逻辑高电平与其VH引脚电压相同，输出逻辑低电平与其VL引脚电压相同；所述宽电压高速驱动器的VS+引脚与驱动电源(8)连接，VS-引脚、VL引脚和GND均接地。
4.根据权利要求1所述的一种宽电压多通道数字IO系统，其特征在于：所述比较电路(10)由宽电压高速比较器组成，所述宽电压高速比较器的同相端与对外接口(2)连接，反相端与基准产生电路(11)连接，输出逻辑与FPGA电路(1)连接。
5.根据权利要求1所述的一种宽电压多通道数字IO系统，其特征在于：所述总线接口(3)为PCI、PXI、VXI、USB中任意一种。
6.根据权利要求1所述的一种宽电压多通道数字IO系统，其特征在于：所述SDRAM电路(4)由两个均与FPGA电路(1)连接的SDRAM芯片组成。
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