[实用新型]一种基于FPGA的TDD-LTE同步模块有效
| 申请号： | 201922421138.X | 申请日： | 2019-12-30 |
| 公开（公告）号： | CN210578536U | 公开（公告）日： | 2020-05-19 |
| 发明（设计）人： | 谢思坦 | 申请（专利权）人： | 深圳市傲立电子有限公司 |
| 主分类号： | H04B1/40 | 分类号： | H04B1/40;H04W56/00 |
| 代理公司： | 武汉臻诚专利代理事务所(普通合伙) 42233 | 代理人： | 陈玉 |
| 地址： | 518053 广东省深*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 fpga tdd lte 同步 模块 | ||
1.一种基于FPGA的TDD-LTE同步模块，其特征在于，包括：天线、运算放大器、混频器、本振芯片、模数转换器、FPGA芯片及晶振；其中：
所述天线用于接收外部射频信号并输出；
所述运算放大器，其输入端与所述天线输出端连接，用于接收所述射频信号并放大；
所述混频器，其包括2个输入端，其中一个输入端与所述运算放大器的输出端相连，用于接收放大后的射频信号；其另一个输入端与所述本振芯片的输出端相连，用于接收本振芯片输出的另一频率的射频信号；所述混频器用于将其输入端接收到的两个射频信号进行混频处理并输出预设频率的射频信号；
所述模数转换器，其输入端与所述混频器的输出端相连，以接收所述混频器输出的射频信号，并将该射频信号转换为数字信号；
所述FPGA芯片，其输入端与所述模数转换器输出端连接，以接收所述模数转换器输出的数字信号并处理，以输出TDD-LTE同步信号；
所述晶振与所述模数转换器、FPGA芯片及本振芯片均信号连接，用于为所述模数转换器、FPGA芯片及本振芯片提供工作时钟信号。
2.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述预设频率为1880MHz～2635MHz。
3.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述本振芯片，其输出的射频信号为1880MHz～2635MHz。
4.如权利要求3所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述本振芯片为美信公司的MAX2870。
5.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述运算放大器，其将接收到的射频信号放大20dB～40dB。
6.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述时钟信号为本地晶振或外部时钟电路。
7.如权利要求6所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述时钟信号为20MHz～40MHz。
8.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述FPGA为西安智多晶的SL2-25。
9.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述模数转换器为美信公司的MAX1421。
10.如权利要求1所述的基于FPGA的TDD-LTE同步模块，其特征在于，所述混频器为韩国RM公司的RM210。
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