[发明专利]基于蚀刻残渣的抑制剂的选择性处理在审
申请号: | 201980018132.8 | 申请日: | 2019-01-15 |
公开(公告)号: | CN111819659A | 公开(公告)日: | 2020-10-23 |
发明(设计)人: | 卡希什·沙玛;特塞翁格·金姆;萨曼莎·坦;丹尼斯·M·豪斯曼 | 申请(专利权)人: | 朗姆研究公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/683;H01L21/67;C23C16/44 |
代理公司: | 上海胜康律师事务所 31263 | 代理人: | 李献忠;邱晓敏 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 基于 蚀刻 残渣 抑制剂 选择性 处理 | ||
1.一种在半导体衬底上进行沉积的方法,该方法包括:
在半导体衬底上选择性地沉积牺牲材料,所述衬底包括具有多个衬底材料区域的表面,所述多个衬底材料区域对于所述牺牲材料具有不同的选择性,使得在所述衬底表面的第一区域上发生所述牺牲材料的实质性沉积,而在所述衬底表面的第二区域上没有发生实质性沉积;
在所述衬底上沉积非牺牲材料,使得在所述第二区域上发生所述非牺牲材料的实质性沉积,并且在所述第一区域上的牺牲材料上没有发生所述非牺牲材料的实质性沉积;以及
去除所述牺牲材料,使得仅在所述第二区域上实质性发生所述非牺牲材料的净沉积。
2.根据权利要求1所述的方法,其中所述非牺牲材料的所述沉积的所述选择性基于所述第一区域的衬底材料和所述第二区域的衬底材料的电特性的差异。
3.根据权利要求1所述的方法,其中所述牺牲材料的沉积通过非共价键合发生在所述衬底表面的第一区域上,并且所述非牺牲材料的沉积通过共价键合发生在所述衬底表面的所述第二区域上。
4.根据权利要求1所述的方法,其中所述非牺牲材料在所述第二区域上的所述实质性沉积以及所述非牺牲材料在所述衬底的所述第一区域上的所述牺牲材料上的非实质性沉积具有化学基础。
5.根据权利要求1-4中任一项所述的方法,其中,所述第一区域和所述第二区域分别是电介质和金属。
6.根据权利要求1-4中任一项所述的方法,其中,所述第一区域和所述第二区域分别是不同的电介质。
7.根据权利要求6所述的方法,其中,所述不同的电介质具有不同的介电常数。
8.根据权利要求7所述的方法,其中,所述第一区域的所述介电常数低于所述第二区域的所述介电常数。
9.根据权利要求8所述的方法,其中,所述第二区域的介电常数比所述第一区域的介电常数大至少三倍。
10.根据权利要求8所述的方法,其中,所述第一区域的所述电介质是SiO2或SiN,并且所述第二区域的所述电介质是ZrO2。
11.根据权利要求1或10所述的方法,其中,所述牺牲材料是碳氟化合物(CFx)或硼氧化物(BOxCly)。
12.根据权利要求1所述的方法,其中,所述非牺牲材料是金属。
13.根据权利要求12所述的方法,其中,所述金属选自由Cu、Al、W、Co和Ti组成的组。
14.根据权利要求1所述的方法,其中,所述非牺牲材料的沉积是均厚沉积。
15.根据权利要求1所述的方法,其中在周期性回蚀/重置操作期间发生所述牺牲材料的所述选择性沉积,在所述周期性回蚀/重置操作期间,所产生的蚀刻残渣为所述选择性沉积提供所述牺牲材料中的一些或全部。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造