[发明专利]用于存储器配置的动态变换的体系结构在审
申请号: | 201980020644.8 | 申请日: | 2019-05-30 |
公开(公告)号: | CN111886575A | 公开(公告)日: | 2020-11-03 |
发明(设计)人: | 纳达夫·博南;朱里斯·曼德尔布拉特;尼尔·苏切尔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06;G06F13/40;G06F13/16 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 杨佳婧 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 存储器 配置 动态 变换 体系结构 | ||
1.一种装置,包括:
第一存储器控制器电路,用于控制经由第一导电总线对第一存储器电路的读取和/或写入访问;
第二存储器控制器电路,用于控制经由第二导电总线对第二存储器电路的读取和/或写入访问;以及
耦合到所述第一存储器控制器电路和所述第二存储器控制器电路的电力控制电路,所述电力控制电路用于将数据从经由所述第二导电总线利用所述第二存储器控制器电路的所述第二存储器电路传送到经由所述第一导电总线利用所述第一存储器控制器电路的所述第一存储器电路,并且所述电力控制电路用于在将所述数据从所述第二存储器电路传送到所述第一存储器电路之后使所述第二存储器电路掉电。
2.如权利要求1所述的装置,其中所述第一存储器控制器电路包括第一多个存储器控制器,其中所述第一存储器电路包括第一多个存储器封装,其中所述第一导电总线包括第一多个通道来将所述第一多个存储器控制器耦合到所述第一多个存储器封装;
其中所述第二存储器控制器电路包括第二多个存储器控制器,其中所述第二存储器电路包括第二多个存储器封装,其中所述第二导电总线包括第二多个通道来将所述第二多个存储器控制器耦合到所述第二多个存储器封装。
3.如权利要求2所述的装置,其中所述电力控制电路用于通过使所述第二多个存储器控制器和所述第二多个存储器封装掉电来使所述第二存储器电路掉电。
4.如权利要求1至3的任何一项所述的装置,还包括:
处理器核心,用于执行操作系统,其中所述操作系统用于将所述第一存储器电路和所述第二存储器电路的数据的页的至少一半传送到持续性存储装置中的一个或多个文件,所述操作系统用于将所述第一存储器电路和所述第二存储器电路的数据的剩余页移动到所述第一存储器电路和所述第二存储器电路内的一组连续的存储器页。
5.如权利要求4所述的装置,其中将所述第一存储器电路和所述第二存储器电路的数据的剩余页移动到所述第一存储器电路和所述第二存储器电路内的所述一组连续的存储器页导致所述第一存储器电路内的存储器的空置页和所述第二存储器电路内的存储器的被占用页。
6.如权利要求5所述的装置,其中将所述数据从所述第二存储器电路传送到所述第一存储器电路,包括:
将所述第二存储器电路内的存储器的被占用页的数据传送到所述第一存储器电路内的存储器的空置页内的位置。
7.如权利要求5所述的装置,其中将所述数据从所述第二存储器电路传送到所述第一存储器电路,包括:
将所述第二存储器电路内的存储器的动态随机访问存储器(“DRAM”)页传送到所述第一存储器电路内的存储器的DRAM页。
8.如权利要求1至3的任何一项所述的装置,其中,在所述第二存储器电路被掉电的同时,如果新流量映射到所述第二存储器电路内的位置,则所述电力控制电路用于将所述新流量路由到所述第一存储器电路内的位置。
9.如权利要求1至3的任何一项所述的装置,其中所述电力控制电路用于响应于接收到将所述第二存储器电路加电的命令而将所述第二存储器电路加电,其中所述电力控制电路用于将传送的数据从所述第一存储器电路返回到所述第二存储器电路。
10.如权利要求1至3的任何一项所述的装置,其中使所述第二存储器电路掉电包括以下各项中的一个或多个:
停止通过所述第二导电总线向所述第二存储器电路的时钟信号传输;
去除到所述第二存储器电路的电力;
禁用对所述第二存储器电路的自动化自刷新操作;或者
至少部分去除到所述第二存储器控制器电路的电力。
11.如权利要求1至3的任何一项所述的装置,其中所述电力控制电路用于使所述第二存储器电路掉电包括使所述第一存储器电路和所述第二存储器电路的组合的至少一半掉电。
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