[发明专利]具有数据处理引擎阵列的装置在审

专利信息
申请号: 201980022809.5 申请日: 2019-04-01
公开(公告)号: CN112074824A 公开(公告)日: 2020-12-11
发明(设计)人: G·H·比尔斯基;J·J·诺古拉·塞拉;B·奥兹古尔;J·兰格;R·L·瓦尔克;R·D·维蒂格;K·A·维塞斯;P·B·詹姆斯-罗克斯比;C·H·迪克 申请(专利权)人: 赛灵思公司
主分类号: G06F15/173 分类号: G06F15/173;G06F15/78
代理公司: 北京市金杜律师事务所 11256 代理人: 闫昊
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 具有 数据处理 引擎 阵列 装置
【说明书】:

装置可以包括多个数据处理引擎(304)。每个数据处理引擎(304)可以包括核心(602)和存储器模块(604)。每个核心(602)可以被配置成访问相同数据处理引擎[304]中的存储器模块(604)和多个数据处理引擎(304)中的至少一个其他数据处理引擎(304)内的存储器模块(604)。

技术领域

本公开涉及集成电路装置(装置),并且更具体地,涉及包括数据处理引擎和/或数据处理引擎阵列的装置。

背景技术

可编程集成电路(IC)是指包括可编程电路的一种类型的IC。可编程IC的一个示例是现场可编程门阵列(FPGA)。FPGA的特征在于包括可编程电路块。可编程电路块的示例包括但不限于输入/输出块(IOB)、可配置逻辑块(CLB)、专用随机存取存储器块(BRAM)、数字信号处理块(DSP)、处理器、时钟管理器和延迟锁定环(DLL)。

通过将配置数据(有时称为配置比特流)加载到装置中,可以在可编程IC的可编程电路系统内物理地实现电路设计。配置数据可以被加载到装置的内部配置存储器单元中。各个配置存储器单元的集合状态确定可编程IC的功能。例如,由各种可编程电路块执行的特定操作和可编程IC的可编程电路块之间的连接性由一旦加载有配置数据的配置存储器单元的集合状态来定义。

发明内容

在一个或多个实施例中,装置可以包括多个数据处理引擎。每个数据处理引擎可以包括一个核心和一个存储器模块。每个核心可以被配置成访问相同数据处理引擎中的存储器模块和多个数据处理引擎中的至少一个其他数据处理引擎内的存储器模块。

在一个或多个实施例中,方法可以包括第一数据处理引擎的第一核心生成数据,第一核心将数据写入第一数据处理引擎内的第一存储器模块,并且第二数据处理引擎的第二核心从第一存储器模块读取数据。

在一个或多个实施例中,装置可以包括多个数据处理引擎、子系统和耦合到多个数据处理引擎和子系统上的片上系统(SoC)接口块。SoC接口块可以被配置成在子系统与多个数据处理引擎之间交换数据。

在一个或多个实施例中,SoC接口块的瓦片可以包括存储器映射交换机,存储器映射交换机被配置成将配置数据的第一部分提供给相邻瓦片,并且将配置数据的第二部分提供给多个数据处理引擎中的一个数据处理引擎。瓦片可以包括流交换机,流交换机被配置成将第一数据提供给至少一个相邻瓦片且将第二数据提供给多个数据处理引擎中的数据处理引擎。瓦片可以包括被配置成接收在瓦片内产生的事件和来自瓦片外部的电路的事件的事件广播电路系统,其中事件广播电路系统是可编程的,以便将事件中的选定事件提供给选定的目的地。瓦片可以包括接口电路,接口电路将存储器映射交换机、流交换机和事件广播电路系统耦合到包括瓦片的装置的子系统。

在一个或多个实施例中,装置可以包括多个数据处理引擎。数据处理引擎中的每个数据处理引擎可以包括一个核心和一个存储器模块。多个数据处理引擎可以被组织在多个行中。每个核心可以被配置成通过对相邻数据处理引擎的存储器模块的共享访问来与多个数据处理引擎中的其他相邻数据处理引擎进行通信。

在一个或多个实施例中,装置可以包括多个数据处理引擎。数据处理引擎中的每个数据处理引擎可以包括具有多个存储体的存储池、各自耦合到存储池并且被配置成访问多个存储体的多个核心、耦合到存储池和至少一个相邻数据处理引擎的存储器映射交换机、以及耦合到多个核心中的每个核心并耦合到至少一个相邻数据处理引擎的流交换机的流交换机。

提供这个发明内容部分仅是为了介绍某些概念,而不是标识所要求保护的主题的任何关键或必要特征。本发明布置的其它特征将从附图和下面的详细描述中变得明显。

附图说明

本发明布置通过附图中的示例来说明。然而,附图不应被解释为将本发明布置限制到仅示出的特定实施方案。通过阅读以下具体描述并且参考附图,各个方面和优点将变得显而易见。

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