[发明专利]用于幽灵缓解的数据高速缓存隔离在审

专利信息
申请号: 201980025381.X 申请日: 2019-04-03
公开(公告)号: CN112602068A 公开(公告)日: 2021-04-02
发明(设计)人: P.T.罗宾逊 申请(专利权)人: 索尼互动娱乐股份有限公司
主分类号: G06F12/0897 分类号: G06F12/0897;G06F12/14;G06F12/084;G06F21/52;G06F21/74;G06F12/0846
代理公司: 北京市柳沈律师事务所 11105 代理人: 张晓明
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 幽灵 缓解 数据 高速缓存 隔离
【权利要求书】:

1.一种装置,所述装置包括:

至少一个中央处理单元(CPU)核心,所述至少一个CPU核心包括:

至少第一CPU线程;

至少第一L1高速缓存,所述第一CPU线程可访问所述第一L1高速缓存;

多条信号线,所述多条信号线用于在所述第一CPU线程与所述第一L1高速缓存之间传达数据,所述CPU线程被配置为暴露所述多条信号线中的至少模式信号线上的二进制值,所述模式信号线上的第一二进制值指示仅与内核模式高速缓存相关联的存储器地址,所述模式信号线上的第二二进制值指示仅与用户模式高速缓存相关联的存储器地址,其中与用户模式应用程序相关联的数据只能向用户模式高速缓存写入和从中读取,使得用户模式应用程序无法检测到所述内核模式高速缓存的操作。

2.如权利要求1所述的装置,其中与内核模式应用程序相关联的数据只能向内核模式高速缓存写入和从中读取。

3.如权利要求1所述的装置,其中所述用户模式高速缓存和所述内核模式高速缓存是所述第一L1高速缓存的虚拟分区。

4.如权利要求1所述的装置,所述装置包括第二L1高速缓存,其中所述用户模式高速缓存和所述内核模式高速缓存分别由所述第一L1高速缓存和所述第二L1高速缓存建立。

5.如权利要求1所述的装置,所述装置包括L2高速缓存,其中与用户模式应用程序相关联的数据只能向所述L2高速缓存的用户模式高速缓存写入和从中读取,使得用户模式应用程序无法检测到所述L2高速缓存在内核模式下的操作。

6.如权利要求3所述的装置,其中所述用户模式高速缓存和所述内核模式高速缓存的相应大小在CPU操作期间改变。

7.如权利要求6所述的装置,其中所述大小根据在内核模式软件的控制下的至少一个参数来改变。

8.如权利要求6所述的装置,其中所述大小根据在所述用户模式高速缓存和所述内核模式高速缓存中的至少一者中的数据存储量来改变。

9.如权利要求6所述的装置,其中所述大小根据在所述用户模式高速缓存和所述内核模式高速缓存中的至少一者中的数据输入/输出速率来改变。

10.如权利要求1所述的装置,其中所述CPU核心是第一CPU核心,并且所述装置包括在CPU封装中的至少第二CPU核心,并且所述第一CPU核心和所述第二CPU核心共享L3高速缓存。

11.一种设备,所述设备包括:

至少一个中央处理单元(CPU)核心,所述至少一个CPU核心包括:

至少第一CPU线程;以及

L1高速缓存组件,所述第一CPU线程可访问所述L1高速缓存组件;

所述L1高速缓存组件被分区为用户模式高速缓存和内核模式高速缓存。

12.如权利要求11所述的设备,其中所述L1高速缓存组件包括单个物理L1高速缓存,所述单个物理L1高速缓存被划分为所述用户模式高速缓存和所述内核模式高速缓存。

13.如权利要求11所述的设备,其中所述L1高速缓存组件包括仅建立所述用户模式高速缓存的第一物理L1高速缓存和仅建立所述内核模式高速缓存的第二物理L1高速缓存。

14.如权利要求11所述的设备,其中在用户模式下的CPU操作期间,所有用户模式应用程序都仅被允许对所述用户模式高速缓存执行输入/输出操作,而不允许用户模式应用程序访问或以其他方式“查看”内核模式高速缓存,包括从内核模式高速缓存进行的数据回收。

15.如权利要求14所述的设备,其中在内核模式下操作的程序仅被允许访问内核模式高速缓存,以写入内核模式数据。

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