[发明专利]安全感知总线系统上的外围设备访问在审

专利信息
申请号: 201980055741.0 申请日: 2019-06-26
公开(公告)号: CN112639788A 公开(公告)日: 2021-04-09
发明(设计)人: 罗南·巴尔齐克;贝伦德·德肯斯;弗兰克·奥纳;安德斯·诺尔 申请(专利权)人: 北欧半导体公司
主分类号: G06F21/64 分类号: G06F21/64;G06F13/362;G06F13/42;G06F21/85;G06F21/56;H04L29/06
代理公司: 北京清亦华知识产权代理事务所(普通合伙) 11201 代理人: 张润
地址: 挪威特*** 国省代码: 暂无信息
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摘要:
搜索关键词: 安全 感知 总线 系统 外围设备 访问
【权利要求书】:

1.一种集成电路设备,包括:

处理器;

外围组件;

总线系统,其连接到所述处理器和所述外围组件,并配置为承载总线事务;和

硬件过滤器逻辑,

其中:

所述总线系统被配置为承载用于区分安全总线事务和非安全总线事务的安全状态信号;

所述外围组件包括可通过所述总线系统访问的寄存器接口,所述寄存器接口包括硬件寄存器;

所述外围组件包括直接内存访问(DMA)控制器,用于在所述总线系统上启动总线事务;和

所述外围组件支持安全入和非安全出状态,其中:

所述硬件过滤器逻辑被配置为防止非安全总线事务访问所述外围组件的所述硬件寄存器,但是允许安全总线事务访问所述外围组件;

所述外围组件被配置为允许传入的安全总线事务访问所述硬件寄存器;和

所述外围组件被配置为在所述总线系统上启动作为非安全总线事务的总线事务。

2.根据权利要求1所述的集成电路设备,其中所述硬件过滤器逻辑被配置为防止非安全总线事务到达所述外围组件。

3.根据权利要求1或2所述的集成电路设备,其中所述硬件过滤器逻辑被配置为在所述总线系统内的一个或多个拦截点处拦截总线事务,每个拦截点位于所述总线系统内,使得来自至少两个主组件的总线事务通过所述拦截点,并且至少两个从组件的总线事务通过所述拦截点。

4.根据权利要求3所述的集成电路设备,其中所述硬件过滤器逻辑被配置为对于每个被拦截的总线事务,使用i)被拦截的总线事务的从地址,和ii)被拦截的总线事务的安全状态,以确定根据一组过滤规则是否允许被拦截的总线事务,并且被配置为阻止被确定为不允许的被拦截的总线事务。

5.根据权利要求4所述的集成电路设备,其中所述过滤规则对于主组件和从组件的每个配对,确定所述从组件是否被允许接收由所述主组件启动的安全总线事务,以及所述从组件是否应接收由所述主组件启动的非安全总线事务。

6.根据任一前述权利要求所述的集成电路设备,其中所述外围组件可在所述安全入和非安全出状态与非安全状态之间切换,其中:

所述硬件过滤器逻辑被配置为允许非安全总线事务访问所述硬件寄存器;和

所述外围组件被配置为在所述总线系统上启动作为非安全总线事务的总线事务。

7.一种操作集成电路设备的方法,其中所述集成电路设备包括:

处理器;

外围组件;和

总线系统,其连接到所述处理器和所述外围组件,并配置为承载安全总线事务和非安全总线事务,其中所述外围组件包括可通过所述总线系统访问的寄存器接口,所述寄存器接口包括硬件寄存器,

所述方法包括所述外围组件处于安全入和非安全出状态,并且当所述外围组件处于安全入和非安全出状态时:

防止非安全总线事务访问所述外围组件的所述硬件寄存器;

允许传入的安全总线事务访问所述硬件寄存器;和

所述外围组件在所述总线系统上启动非安全总线事务。

8.一种集成电路设备,包括:

处理器;

外围组件;和

总线系统,其连接到所述处理器和所述外围组件,并配置为承载总线事务,

其中:

所述外围组件包括可通过所述总线系统访问的寄存器接口,所述寄存器接口包括第一硬件寄存器和第二硬件寄存器;

所述总线系统被配置为承载用于区分安全总线事务和非安全总线事务的安全状态信号;

所述外围组件包括用于从所述总线系统接收安全状态信号的输入;和

所述外围组件支持分拆安全状态,其中所述外围组件配置为:

防止非安全总线事务访问第一硬件寄存器;

允许安全总线事务访问第一硬件寄存器;和

允许非安全总线事务访问第二硬件寄存器。

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