[发明专利]数字信号加密解密的电路和方法在审

专利信息
申请号: 202010024045.8 申请日: 2020-01-05
公开(公告)号: CN112787798A 公开(公告)日: 2021-05-11
发明(设计)人: 陈麟华 申请(专利权)人: 陈麟华
主分类号: H04L9/06 分类号: H04L9/06;H04L9/08
代理公司: 暂无信息 代理人: 暂无信息
地址: 310005 浙江省杭州市莫*** 国省代码: 浙江;33
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摘要:
搜索关键词: 数字信号 加密 解密 电路 方法
【权利要求书】:

1.数字信号加密解密的电路和方法,一种使用对称密钥的加解密电路,它包括“数字信号加密电路”和“数字信号解密电路”,这两者是相互对应、需要配对使用的,这两者合称为“数字信号加密解密电路”,其特征是:

加密电路和解密电路,均具有“数码加解密变换电路”(1),“密钥存储电路”(2),

“数码加解密变换电路”(1)具有“明钥变换电路”(12)、“密钥变换电路”(13)、“混合变换电路”(15)和“末级变换电路”(29),

“明钥变换电路”(12)和“密钥变换电路”(13)的输出均送至“混合变换电路”(15),“混合变换电路”(15)的输出,形成“变易密钥”,送至“末级变换电路”(29),

这其中,“明钥变换电路”(12)和“密钥变换电路”(13)由移位寄存电路构成,

“混合变换电路”(15),由逻辑门电路、组合逻辑电路和时序逻辑电路构成,具有多路的输入,

这种由逻辑门电路、组合逻辑电路和时序逻辑电路构成的组合电路,称之为“码位互控变换电路”,简称“码控变换电路”(16),

“码控变换电路”(16)是多输入端的组合电路,内部具有基本逻辑电路、组合逻辑电路、时序逻辑电路中的一种或者多种,

“码控变换电路”(16)由这些数字电路进行串联、并联或者混联,输入端的其中一部分作为输入数据端,另一部分作为控制端,也即,这种电路的输入一部分作为“控制码”,另一部分作为“受控码”,由控制端的控制码,决定输入输出关系,

“混合变换电路”(15)的内部,或者由多个“码控变换电路”组成,各个“码控变换电路”,彼此间平行排列,或者进行串接或交叉混接,形成嵌套、级联,或者反馈,

所谓嵌套,就是组成码控变换电路的内部模块也具有码控变换电路,

所谓级联,就是码控变换的输出后,数据重新排列,或插入插入新的数据,进行新的码控变换,

所谓反馈,是指输出数据,中间通过锁存电路,反送到本级、或者前一级或前几级的输入端,

“明钥变换电路”(12)和“密钥变换电路”(13),或者也具有“码控变换电路”(16),

“末级变换电路”(29)是由“异或”电路构成,

对于加密电路,使待加密的数据信息与“变易密钥”在“末级变换电路”(29)进行“异或”,形成加密的数据信息,

对于解密电路,使已加密的数据信息与“变易密钥”在“末级变换电路”(29)进行“异或”,形成解密的数据信息,

这种“异或”是以数据流的形式进行的,

待加密或待解密的数据,其数字信号的脉冲频率,构成脉冲时钟的基准频率,

变换电路中的各时序电路,其脉冲触发的时钟信号,或者是与基准信号同频同步的,或分频的,

或者,各时序电路的脉冲时钟频率是码控选择的,通过选择器与分频电路的组合,对基准时钟进行“码控”的分频,形成不同频率的脉冲时钟信号,

数字信号的加密解密电路,或者还具有“数据格式设别和分离电路”(3)和“数据格式重建电路”(4),待加密/解密的数字信号通过电路端口输入后,先经过“数据格式设别和分离电路”(3),分离出非格式信号,再输入到“数码加解密变换电路”(1)进行相应的加密或解密的变换,变换后的信号,输入到“数据格式重建电路”(4),“数据格式重建电路”(4)再把变换后的信号与格式信号组合,重新构建成格式信号,从电路输出端口输出,

所述的“数据格式设别和分离电路”(3),是指通过比较电路,比较数据格式与预先记录存储的格式是否相同,一旦相同,则进行分离,

所述的“数据格式重建电路”(4),是指与分离相对应的,在完成加密后,重新恢复相应的数据格式,

数字信号的加密解密电路,或者还具有“A/D转换电路”和“D/A转换电路”,加密电路中,在“数码加解密变换电路”(1)前有“A/D转换电路”,解密电路中,在“数码加解密变换电路”(1)后有“D/A转换电路”。

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