[发明专利]一种FPGA的单向链表数据存储方法及系统有效
申请号: | 202010079637.X | 申请日: | 2020-02-04 |
公开(公告)号: | CN111259014B | 公开(公告)日: | 2023-01-10 |
发明(设计)人: | 王凯;张贞雷;魏红杨;邹晓峰;吕垣森 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G06F16/22 | 分类号: | G06F16/22;G06F16/245;G06F16/2455;G06F3/06;G06F15/78 |
代理公司: | 济南舜源专利事务所有限公司 37205 | 代理人: | 李舜江 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 fpga 单向 数据 存储 方法 系统 | ||
1.一种FPGA的单向链表数据存储方法,其特征在于,包括:
将片内RAM和片外DDR均划分为多个节点,将片内RAM节点和片外DDR节点依次构建成FPGA的单向链表,并设置节点的指针;
将FPGA的寄存器地址配置为单向链表的索引地址;
将数据包的配置信息缓存到片内RAM节点,所述数据包的数据缓存到片外DDR节点;
所述方法还包括:
根据FPGA的存储数据读取指令获取寄存器地址;
根据所述寄存器地址索引到待测数据包所在的RAM节点,并读取待测数据包的配置信息;
根据片内RAM节点的指针索引到片外DDR节点,并读取待测数据包的数据;
所述数据包的配置信息包括数据配置信息和链表配置信息。
2.根据权利要求1所述的一种FPGA的单向链表数据存储方法,其特征在于,所述方法还包括:
CPU通过总线读取待测数据包的配置信息;
DAM通过DMA交互模块读取待测数据包的数据。
3.根据权利要求1所述的一种FPGA的单向链表数据存储方法,其特征在于,所述方法还包括:
将所述单向链表的第一个片内RAM节点配置为链表头;
所述链表头内输入链表配置信息。
4.根据权利要求1述的一种FPGA的单向链表数据存储方法,其特征在于,所述数据配置信息包括:数据包大小、数据包数量、数据包是否校验信息和数据校验位。
5.根据权利要求2所述的一种FPGA的单向链表数据存储方法,其特征在于,所述链表配置信息包括的单向链表的数据类型,传输通道,优先级,路由信息和目的地址。
6.一种FPGA的单向链表数据存储系统,其特征在于,包括:
结构分配单元,配置用于将片内RAM和片外DDR均划分为多个节点,将片内RAM节点和片外DDR节点依次构建成FPGA的单向链表,并设置节点的指针;
寄存器配置单元,配置用于将FPGA的寄存器地址配置为单向链表的索引地址;
数据存储单元,配置用于将数据包的配置信息缓存到片内RAM节点,所述数据包的数据缓存到片外DDR节点;
所述系统还包括:
读取指令单元,配置用于根据FPGA的存储数据读取指令获取寄存器地址;
地址索引单元,配置用于根据所述寄存器地址索引到待测数据包所在的片内RAM节点,并读取待测数据包的配置信息;
数据读取单元,配置用于根据片内RAM节点的指针索引到片外DDR节点,并读取待测数据包的数据;
所述数据包的配置信息包括数据配置信息和链表配置信息。
7.根据权利要求6所述的一种FPGA的单向链表数据存储系统,其特征在于,所述系统还包括:
表头配置单元,配置用于将所述单向链表的第一个片内RAM节点配置为链表头;
表头信息输入单元,配置用于所述链表头内输入链表配置信息。
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