[发明专利]一种提升SOC系统可靠性和异常重启性能的方法和装置有效
申请号: | 202010095401.5 | 申请日: | 2020-02-17 |
公开(公告)号: | CN111427719B | 公开(公告)日: | 2023-06-13 |
发明(设计)人: | 谢修鑫 | 申请(专利权)人: | 瑞芯微电子股份有限公司 |
主分类号: | G06F11/14 | 分类号: | G06F11/14 |
代理公司: | 福州市京华专利代理事务所(普通合伙) 35212 | 代理人: | 林燕 |
地址: | 350000 福建省*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 一种 提升 soc 系统 可靠性 异常 性能 方法 装置 | ||
1.一种提升SOC系统可靠性和异常重启性能的方法,其特征在于:
将SOC芯片的IO脚SOC_RESET和PMIC的IO脚PMIC_RESET连接;
对PMIC进行配置,使SOC芯片在 reset时通过控制IO脚SOC_RESET的电平状态进而控制PMIC进行如下的RESET操作:
(1)只恢复寄存器值到默认值进而恢复默认电压,同时reset PMIC的通信接口控制单元;
其中,PMIC的配置情况如下:
(a)PMIC随系统上电后,内部默认配置为不响应IO脚PMIC_RESET的任何输入信号;
(b)系统运行起来后,IO脚PMIC_RESET被配置为响应IO脚SOC_RESET的电平状态而收到相应电平状态时进行所述的RESET操作;
(c)PMIC到SOC芯片的输出电路配置了最高限制电压;
所述SOC芯片在 reset时控制IO脚SOC_RESET的电平状态进而控制PMIC的RESET操作具体是:
(A)IO脚SOC_RESET为普通GPIO,GPIO的上电初始状态及reset状态为输入或输出第一电平状态时,系统上电后先配置IO脚SOC_RESET为输出第二电平状态,再配置PMIC的IO脚PMIC_RESET响应输入第一电平状态时进行PMIC复位;或
(B)SOC芯片通过内部的复位信号控制IO脚SOC_RESET脚的输出,在系统上电后先配置IO脚SOC_RESET在没有收到内部复位信号时输出第一电平状态,收到内部复位信号时输出第二电平状态;再配置PMIC的IO脚PMIC_RESET响应输入第二电平状态时进行PMIC复位;
其中,当第一电平状态为低电平状态时,第二电平状态则为高电平状态,反之,当第一电平状态为高电平状态时,第二电平状态则为低电平状态。
2.根据权利要求1所述的一种提升SOC系统可靠性和异常重启性能的方法,其特征在于:所述RESET操作还包括:
(2)PMIC自己所有功能重新复位,同时reset PMIC的通信接口控制单元。
3.一种提升SOC系统可靠性和异常重启性能的装置,其特征在于:包括:
Reset控制模块,在SOC芯片的IO脚SOC_RESET和PMIC的IO脚PMIC_RESET连接的前提下,用于SOC芯片在 reset时通过控制IO脚SOC_RESET的电平状态进而控制PMIC进行如下的RESET操作:
(1)只恢复寄存器值到默认值进而恢复默认电压,同时reset PMIC的通信接口控制单元;
配置及控制模块,用于按照如下配置控制PMIC完成工作:
(a)PMIC随系统上电后,内部默认配置为不响应IO脚PMIC_RESET的任何输入信号;
(b)系统运行起来后,IO脚PMIC_RESET被配置为响应IO脚SOC_RESET的电平状态而收到相应电平状态时进行所述的RESET操作;
(c)PMIC到SOC芯片的输出电路配置了最高限制电压;
所述SOC芯片在 reset时控制IO脚SOC_RESET的电平状态进而控制PMIC的RESET操作具体是:
(A)IO脚SOC_RESET为普通GPIO,GPIO的上电初始状态及reset状态为输入或输出第一电平状态时,系统上电后先配置IO脚SOC_RESET为输出第二电平状态,再配置PMIC的IO脚PMIC_RESET响应输入第一电平状态时进行PMIC复位;或
(B)SOC芯片通过内部的复位信号控制IO脚SOC_RESET脚的输出,在系统上电后先配置IO脚SOC_RESET在没有收到内部复位信号时输出第一电平状态,收到内部复位信号时输出第二电平状态;再配置PMIC的IO脚PMIC_RESET响应输入第二电平状态时进行PMIC复位;
其中,当第一电平状态为低电平状态时,第二电平状态则为高电平状态,反之,当第一电平状态为高电平状态时,第二电平状态则为低电平状态。
4.根据权利要求3所述的一种提升SOC系统可靠性和异常重启性能的装置,其特征在于:所述RESET操作还包括:
(2)PMIC自己所有功能重新复位,同时reset PMIC的通信接口控制单元。
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