[发明专利]硬件索引映射机制在审
申请号: | 202010124077.5 | 申请日: | 2020-02-27 |
公开(公告)号: | CN111798362A | 公开(公告)日: | 2020-10-20 |
发明(设计)人: | P·多伊尔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06T1/20 | 分类号: | G06T1/20;G06F13/16;G06F16/22 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈依心;何焜 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 硬件 索引 映射 机制 | ||
本申请公开了硬件索引映射机制。公开了一种用于促进索引映射的装置。该装置包括:存储器;以及索引映射硬件,耦合至存储器,用于从存储器检取位图,处理位图以生成指示该位图中已经被置位的位的一个或多个映射向量,并且将一个或多个映射向量存储在存储器中。
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技术领域
本发明总体上涉及图形处理,并且更具体地涉及经由图形处理单元的网格着色。
背景技术
图形处理单元(GPU)是高度线程化机器,其中并行地执行程序的数百个线程以实现高吞吐量。GPU线程组被实现在网格着色应用中以执行三维(3D)渲染。与使用3D固定功能几何流水线级相比,新兴的网格着色器3D应用支持生成一组图形对象(称为“小网格(meshlet)”)。在网格着色期间,通常将所生成的对象(例如,一组顶点和引用那些顶点的基元拓扑(“基元”))传递到设置和栅格化级以渲染到场景中。结果,与可用几何固定功能的限制不同,执行网格着色器的线程组可以利用GPU的全部计算资源来提供性能缩放。
通常由网格着色器执行的一项功能是对小网格图形对象的可见性剔除。通过阻止不可见的对象提交到设置和栅格化级,这些级的可用吞吐量可以完全专用于通过处理实际影响场景图像的对象来提高渲染性能。然而,小网格可见性剔除操作可能会导致对可见对象的稀疏收集。因此,网格着色器线程组紧接在剔除操作之后执行对可见对象的压缩(compaction)。压缩产生最小的一组紧密打包且高效的活动线程,这允许将不需要的线程槽返回到无计算线程池,以供后续网格着色器操作(例如,像素着色等)使用。当前的3D网格应用通常通过软件执行压缩过程(例如,使用由着色器编译器提供的指令支持),这需要复杂的算法。
附图说明
为了以能够详细理解本发明的以上记载特征的方式,可通过参考实施例来对以上简要概括的本发明进行更具体的描述,这些实施例中的一些在所附附图中被图示。然而,应注意的是,附图仅展示本发明的典型的实施例,且因此将不被视为限制其范围,因为本发明可以承认其他等效实施例。
图1是根据实施例的处理系统的框图;
图2是根据实施例的处理器的框图;
图3是根据实施例的图形处理器的框图;
图4是根据一些实施例的图形处理器的图形处理引擎的框图;
图5是由附加实施例提供的图形处理器的框图;
图6A和图6B图示线程执行逻辑,该线程执行逻辑包括在一些实施例中采用的处理元件阵列;
图7是图示根据一些实施例的图形处理器指令格式的框图;
图8是根据另一个实施例的图形处理器的框图;
图9A和图9B图示根据一些实施例的图形处理器命令格式和命令序列;
图10图示根据一些实施例的用于数据处理系统的示例性图形软件架构;
图11A和图11B是图示根据实施例的IP核开发系统的框图;
图12是图示根据实施例的示例性芯片上系统集成电路的框图;
图13A和图13B是图示附加的示例性图形处理器的框图;
图14A和图14B是图示根据实施例的芯片上系统集成电路的附加示例性图形处理器的框图;
图15图示根据实施例的采用索引映射机制的计算设备;
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