[发明专利]存储结构及其制备方法有效
申请号: | 202010134948.1 | 申请日: | 2020-03-02 |
公开(公告)号: | CN111403404B | 公开(公告)日: | 2021-08-13 |
发明(设计)人: | 徐伟;杨星梅;王健舻;吴继君;黄攀;周文斌 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/11582 |
代理公司: | 北京汉之知识产权代理事务所(普通合伙) 11479 | 代理人: | 高园园 |
地址: | 430074 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 存储 结构 及其 制备 方法 | ||
1.一种存储结构制备方法,其特征在于,包括以下步骤:
提供基底;
先在所述基底上形成第一堆叠结构,而后形成刻蚀停止层,之后形成第二堆叠结构,以形成堆叠结构,所述堆叠结构包括位于所述基底上的所述第一堆叠结构和所述第二堆叠结构,所述第一堆叠结构和所述第二堆叠结构之间形成有所述刻蚀停止层;
而后,形成贯穿所述第一堆叠结构和所述第二堆叠结构以及刻蚀停止层的沟道结构,所述沟道结构插入所述基底;
而后,刻蚀所述第二堆叠结构,形成第二台阶堆叠结构;
而后,形成第二伪沟道结构、第二伪狭缝结构、第二台阶栅堆叠结构及第二导电接触,其中,所述第二导电接触包括具有同一平面的第二贯穿接触、第二台阶接触及沟道局部接触;
而后,刻蚀所述第一堆叠结构,形成第一台阶堆叠结构;其中,所述第一台阶栅堆叠结构及第二台阶栅堆叠结构沿所述刻蚀停止层对称分布;
而后,形成第一伪沟道结构、第一伪狭缝结构、第一台阶栅堆叠结构及第一导电接触,其中,所述第一导电接触包括具有同一平面的第一贯穿接触、第一台阶接触及公共源极局部接触。
2.根据权利要求1所述的存储结构制备方法,其特征在于,在形成所述第一台阶堆叠结构之前,包括:
减薄所述基底;
刻蚀部分所述第一堆叠结构和减薄后的所述基底,形成台阶区和非台阶区,且所述基底位于所述非台阶区。
3.根据权利要求1所述的存储结构制备方法,其特征在于,形成贯穿所述第一堆叠结构和所述第二堆叠结构以及刻蚀停止层的所述沟道结构的步骤包括:
于所述基底上形成所述第一堆叠结构,所述第一堆叠结构包括交替层叠的第一电介质层及第一牺牲层;
形成贯穿所述第一堆叠结构的第一沟道孔,并填充支撑材料;
于所述第一堆叠结构上形成所述刻蚀停止层;
于所述刻蚀停止层上形成所述第二堆叠结构,所述第二堆叠结构包括交替层叠的第二电介质层及第二牺牲层;
形成贯穿所述第二堆叠结构及刻蚀停止层的第二沟道孔;
去除位于所述第一沟道孔中的所述支撑材料;
在所述第一沟道孔和所述第二沟道孔中形成所述沟道结构。
4.根据权利要求1所述的存储结构制备方法,其特征在于:所述刻蚀停止层包括氮化硅层、氮氧化硅层、氧化铝层、氧化铪层、氧化锆层中的一种或组合叠层。
5.根据权利要求1所述的存储结构制备方法,其特征在于:还包括在所述第二台阶堆叠结构侧形成载体晶圆,在所述基底侧形成CMOS晶圆,以及在形成所述CMOS晶圆后,去除所述载体晶圆的步骤。
6.根据权利要求1所述的存储结构制备方法,其特征在于:还包括形成贯穿所述第二台阶堆叠结构的第二狭缝结构及贯穿所述第一台阶堆叠结构和所述刻蚀停止层的第一狭缝结构的步骤,且所述第二狭缝结构与所述第一狭缝结构电连接。
7.根据权利要求6所述的存储结构制备方法,其特征在于:还包括形成与所述第二狭缝结构电连接的公共源极局部接触的步骤。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的