[发明专利]一种参数可调的窄脉冲产生电路在审

专利信息
申请号: 202010250577.3 申请日: 2020-04-01
公开(公告)号: CN111404515A 公开(公告)日: 2020-07-10
发明(设计)人: 覃良标;鲁正;付益;陈昉 申请(专利权)人: 中国电子科技集团公司第三十四研究所
主分类号: H03K3/335 分类号: H03K3/335
代理公司: 桂林市持衡专利商标事务所有限公司 45107 代理人: 欧阳波
地址: 541004 广西壮*** 国省代码: 广西;45
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摘要:
搜索关键词: 一种 参数 可调 脉冲 产生 电路
【权利要求书】:

1.一种参数可调的窄脉冲产生电路,其包括触发器,其特征在于:

所述触发器为D类触发器;还包括复杂可编程逻辑器件CPLD或者现场可编程门阵列FPGA、以及可编程延时芯片,晶振接入CPLD或者FPGA提供标准时钟;CPLD或者FPGA产生方波脉冲信号,该方波脉冲信号分成两路分别进入两片可编程延时芯片,CPLD或者FPGA的延时设置信号接入第一可编程延时芯片的11个延时量设置引脚D0,D1……D10,第一可编程延时芯片设置延时量为T1,第二可编程延时芯片设置延时量为0,第一可编程延时芯片和第二可编程延时芯片延时后的信号分别接入D类触发器的RESET和CLK引脚,D类触发器输出与CPLD或FPGA产生的方波脉冲信号频率一致的窄脉冲信号。

2.根据权利要求1所述参数可调的窄脉冲产生电路,其特征在于:

所述两片可编程延时芯片相同,两片可编程延时芯片的器件固有延时为t,所述t为1~6ns,延时步进为d,d为8~12ps。

3.根据权利要求2所述参数可调的窄脉冲产生电路,其特征在于:

所述CPLD或者FPGA的延时设置信号为11个高电平或低电平信号,依次接入可编程延时芯片的11个延时量设置引脚;CPLD或者FPGA的高电平和低电平信号分别表示二进制数的1和0,11个高电平或低电平的延时设置信号构成11位的二进制数,该二进制数对应的十进制数值与可编程延时芯片的器件的延时步进d的乘积为可编程延时芯片的设置延时量,再加上可编程延时芯片的器件固有延时t等于可编程延时芯片的总延时量。

4.根据权利要求1所述参数可调的窄脉冲产生电路,其特征在于:

所述D类触发器输出窄脉冲信号的脉宽为两个可编程延时芯片的延时量之差,即为T1

5.根据权利要求1所述参数可调的窄脉冲产生电路,其特征在于:

所述晶振的频率等于或大于5MHz。

6.根据权利要求1所述参数可调的窄脉冲产生电路,其特征在于:

所述复杂可编程逻辑器件CPLD和现场可编程门阵列FPGA输出方波脉冲信号的脉宽大于所需输出的方波脉冲信号的脉宽。

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