[发明专利]一种交换机系统及其网口时间同步方法有效
申请号: | 202010289927.7 | 申请日: | 2020-04-14 |
公开(公告)号: | CN111478863B | 公开(公告)日: | 2022-02-11 |
发明(设计)人: | 徐进明;蒋沙沙;高阳;詹晋川 | 申请(专利权)人: | 深圳市风云实业有限公司 |
主分类号: | H04L49/10 | 分类号: | H04L49/10;H04J3/06 |
代理公司: | 北京正华智诚专利代理事务所(普通合伙) 11870 | 代理人: | 杨浩林 |
地址: | 518057 广东省深圳市福田区*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 交换机 系统 及其 时间 同步 方法 | ||
1.一种交换机系统的网口时间同步方法,其交换机系统包括:交换机背板、主控交换板、时钟板和N块业务板,N为大于1的整数;所述主控交换板、时钟板和N块业务板均与交换机背板固定连接;所述主控交换板与时钟板通信连接,且与N块业务板均通信连接;所述时钟板分别与N块业务板均通信连接;
其特征在于,其方法包括以下步骤:
S1、通过时钟板预设本地默认时间信息;
S2、根据默认时间信息,通过N块业务板得到具有本地时间戳和对端主机时间戳的PTP报文;
S3、将具有本地时间戳和对端主机时间戳的PTP报文输入主控交换板的CPU,并通过主控交换板的CPU计算本地默认时间信息与对端主机时间信息的偏差值;
S4、通过管理接口,将本地默认时间信息与对端主机时间信息的偏差值写入主控交换板的FPGA的寄存器,并通过主控交换板的FPGA及其管理接口将本地默认时间信息与对端主机时间信息的偏差值呈递给时钟板的FPGA;
S5、通过时钟板根据本地默认时间信息与对端主机时间信息的偏差值对本地时间进行校准,得到初步校准后的时间;
S6、通过1PPS+ToD接口将初步校准后的时间同步给N块业务板;
S7、CPU按照设定频率与对端主机进行PTP通信,时钟板根据偏差值持续校准本地时间,并通过1PPS+ToD接口将校准后的时间同步给N块业务板,达到各网口时间同步的目的。
2.根据权利要求1所述的交换机系统的网口时间同步方法,其特征在于,所述步骤S2包括以下分步骤:
S21、通过1PPS+ToD接口将时钟板的默认时间信息同步给N块业务板;
S22、通过主控交换板的CPU,采用最佳主时钟算法,在N块业务板的多个正在与各自的网络上对端主机通信的网口中选取最佳时钟同步网口;
S23、通过最佳时钟同步网口,接收网络上对端主机广播的PTP时间同步报文,该同步报文中包含对端主机打的时间戳,在PTP报文进入与之通信的业务板的交换芯片时,通过交换芯片根据默认时间信息对PTP报文进行打时间戳操作,得到具有本地时间戳和对端主机时间戳的PTP报文。
3.根据权利要求1所述的交换机系统的网口时间同步方法,其特征在于,所述步骤S3包括以下步骤:
S31、通过数据接口将具有本地时间戳和对端主机时间戳的PTP报文呈递给主控交换板的交换芯片,并通过PCIE接口继而呈递给主控交换板的CPU;
S32、根据PTP报文中本地时间戳和对端主机时间戳,计算本地默认时间信息与对端主机时间信息的偏差值。
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