[发明专利]数据传输总线系统、装置及方法在审
申请号: | 202010294288.3 | 申请日: | 2020-04-15 |
公开(公告)号: | CN111314193A | 公开(公告)日: | 2020-06-19 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 联合华芯电子有限公司 |
主分类号: | H04L12/40 | 分类号: | H04L12/40 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 518133 广东省深圳市宝安区新安*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 数据传输 总线 系统 装置 方法 | ||
1.一种数据传输总线系统,其特征在于,包括:
至少两组数据总线,通过数据帧传输节点设备的待发数据;
仲裁总线,通过仲裁帧传输节点设备的多进制符号,所述多进制符号包括由多个门限分隔的不同电压幅值状态;
节点控制器,与至少两组数据总线和仲裁总线连接,所述节点控制器将节点设备输出的多进制符号与仲裁总线上的电压进行比较,若所述多进制符号高于仲裁总线上的电压幅值,则将所述多进制符号输出至仲裁总线,同时与节点控制器连接的节点设备获得仲裁优先权,并通过节点控制器将待发数据发送至数据总线;
存在待发数据的节点设备在时隙的开始至少连续两次发送多进制符号至节点控制器,所述时隙为数据总线传输一个所述数据帧和仲裁总线传输一个所述仲裁帧所需的时间间隔,且具有相同帧号的所述数据帧和所述仲裁帧的起始时间和传输数据时间长度相同,发送第一次多进制符号获得仲裁优先权的节点设备,在下一个时隙的开始将待发数据发送至其中一组数据总线,并停止发送后续的多进制符号,发送第二次多进制符号获得仲裁优先权的节点设备,在下一个时隙的开始将待发数据发送至另一组数据总线,并停止发送后续的多进制符号,以此类推直至数据总线被分配完。
2.如权利要求1所述的数据传输总线系统,其特征在于,所述两组数据总线和仲裁总线具有相同的时隙长度,所述节点控制器在时隙开始时向数据总线或仲裁总线发送数据,并在时隙结束时停止发送数据。
3.如权利要求1所述的数据传输总线系统,其特征在于,所述节点控制器包括仲裁电路,所述仲裁电路包括逻辑线或电路,所述逻辑线或电路包括场效应管和第一比较器,所述场效应管漏极作为输入端与节点设备连接,所述场效应管栅极与第一比较器输出端连接,所述场效应管源极作为输出端与仲裁总线连接,所述第一比较器的反相输入端与场效应管源极连接,所述第一比较器同相输入端与场效应管漏极连接,若所述输入端电压小于所述输出端电压,则所述第一比较器输出高电平驱动场效应管导通,所述场效应管则将输入的多进制符号输出至仲裁总线上,反之所述第一比较器输出低电平,所述场效应管截止。
4.如权利要求3所述的数据传输总线系统,其特征在于,所述逻辑线或电路还包括清除电路,所述清除电路包括下拉电阻和开关管,所述下拉电阻一端与逻辑线或输出端连接,所述下拉电阻另一端与开关管输入端连接,所述开关管输出端接地,所述开关管的控制端与节点控制器连接,所述节点控制器在时隙结束时控制开关管导通。
5.如权利要求3所述的数据传输总线系统,其特征在于,所述仲裁电路还包括误差消除电路,所述误差消除电路输入端与仲裁总线连接,所述误差消除电路输出端与节点控制器连接,所述误差消除电路包括:
门限电路,用于提供与多进制符号对应的若干门限电压,所述门限电压用于区分所述不同电压幅值状态;
再生电路,所述再生电路包括与门限电压对应的若干第二比较器和若干分压电阻,每一个第二比较器的同相输入端与仲裁总线连接,每一个第二比较器的反相输入端用于不同门限电压输入,每一个第二比较器输出端串联一个分压电阻,分压电阻之间并联连接,所述第二比较器将多进制符号与门限电压比较后,生成逻辑电平,全部的逻辑电平经过分压电阻分压后生成多进制符号对应的标准电压;
所述节点控制器将误差消除电路输出标准电压与节点设备输入多进制符号进行比较,若两者一致,则与节点控制器连接的节点设备获得仲裁优先权。
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