[发明专利]一种半浮栅存储器及其制备方法有效
申请号: | 202010346224.3 | 申请日: | 2020-04-27 |
公开(公告)号: | CN111477626B | 公开(公告)日: | 2022-06-21 |
发明(设计)人: | 朱宝;陈琳;孙清清;张卫 | 申请(专利权)人: | 复旦大学;上海集成电路制造创新中心有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 上海正旦专利代理有限公司 31200 | 代理人: | 陆飞;陆尤 |
地址: | 200433 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 半浮栅 存储器 及其 制备 方法 | ||
1.一种半浮栅存储器,其特征在于,
包括:
半导体衬底(200),其具有第一掺杂类型;
半浮栅阱区(201),其具有第二掺杂类型,位于所述半导体衬底(200)的上层区域;
U型槽,贯穿所述半浮栅阱区(201),其底部处于所述半浮栅阱区(201)的下边界;
第一栅极叠层,包括第一栅介质层(203)、浮栅(204)和隧穿晶体管沟道层(205),其中,所述第一栅介质层(203)覆盖所述U型槽的表面;所述浮栅(204)覆盖所述第一栅介质层(203),并形成中间高、两边低的凸起形状;所述隧穿晶体管沟道层(205)覆盖所述浮栅(204)的中间凸起上表面;
第二栅极叠层,包括第二栅介质层(206)和控制栅(207),所述第二栅介质层(206)形成在所述隧穿晶体管沟道层(205)两侧并延伸覆盖所述浮栅(204)表面,所述控制栅(207)覆盖所述第二栅介质层(206)和所述隧穿晶体管沟道层(205)上表面;
栅极侧墙(208),位于所述第一栅极叠层和第二栅极叠层两侧;
源极(209)和漏极(210),形成于所述半浮栅阱区(201)中,位于所述第一栅极叠层和第二栅极叠层两侧;
所述隧穿晶体管沟道层(205)是第二掺杂类型的轻掺杂多晶硅。
2.根据权利要求1所述的半浮栅存储器,其特征在于,
所述第一栅介质层(203)、所述第二栅介质层(206)为SiO2、Al2O3、ZrO2、HfZrO、HfO2、HfAlO、HfSiO及其任意组合的一种。
3.根据权利要求1所述的半浮栅存储器,其特征在于,
所述浮栅(204)是第一掺杂类型的重掺杂的多晶硅层。
4.根据权利要求1所述的半浮栅存储器,其特征在于,
所述控制栅(207)为第二掺杂类型的重掺杂多晶硅层。
5.根据权利要求1所述的半浮栅存储器,其特征在于,
所述控制栅(207)为TiN、TaN、MoN或者WN。
6.一种半浮栅存储器制备方法,其特征在于,
包括以下步骤:
提供具有第一掺杂类型的半导体衬底(200);
在所述半导体衬底(200)的上层区域形成具有第二掺杂类型的半浮栅阱区(201),
在所述半浮栅阱区(201)中刻蚀形成U型槽,使所述U型槽贯穿所述半浮栅阱区(201),且底部处于所述半浮栅阱区(201)的下边界;
形成第一栅极叠层,依次形成第一栅介质层(203)、浮栅(204)和隧穿晶体管沟道层(205),使所述第一栅介质层覆盖所述U型槽的表面,所述浮栅(204)覆盖第一栅介质层(203)并在形成中间高、两边低的凸起形状,所述隧穿晶体管沟道层(205)覆盖所述浮栅(204)的中间凸起上表面;
形成第二栅极叠层,依次形成第二栅介质层(206)和控制栅(207),使所述第二栅介质层(206)形成在所述隧穿晶体管沟道层(205)两侧并延伸覆盖所述浮栅(204)表面,所述控制栅(207)覆盖所述第二栅介质层(206)和所述隧穿晶体管沟道层(205)上表面;
在所述第一栅极叠层和第二栅极叠层两侧形成栅极侧墙(208);
在所述半浮栅阱区中,所述第一栅极叠层和第二栅极叠层两侧形成源极(209)和漏极(210);
所述隧穿晶体管沟道层(205)是第二掺杂类型的轻掺杂多晶硅。
7.根据权利要求6所述的半浮栅存储器制备方法,其特征在于,
所述浮栅(204)是第一掺杂类型的重掺杂的多晶硅层。
8.根据权利要求6所述的半浮栅存储器制备方法,其特征在于,
所述控制栅(207)为第二掺杂类型的重掺杂多晶硅层,或所述控制栅为TiN、TaN、MoN或者WN。
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