[发明专利]自适应分辨率的ARINC818总线仿真测试设备及分辨率自适应方法有效

专利信息
申请号: 202010469986.2 申请日: 2020-05-28
公开(公告)号: CN111601104B 公开(公告)日: 2021-07-06
发明(设计)人: 孙建军;孙文德;李雄飞;袁智;李涛;杨剑;李潇 申请(专利权)人: 湖南安元信息科技有限公司
主分类号: H04N17/00 分类号: H04N17/00
代理公司: 长沙智勤知识产权代理事务所(普通合伙) 43254 代理人: 彭凤琴
地址: 410000 湖南省长沙市长沙高新开发区*** 国省代码: 湖南;43
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摘要:
搜索关键词: 自适应 分辨率 arinc818 总线 仿真 测试 设备 方法
【权利要求书】:

1.一种自适应分辨率的ARINC818总线仿真测试设备,其特征在于,包括ARINC818总线接收模块,所述ARINC818总线接收模块包括ADVB解析单元、第一分辨率检测单元、第一VESA时序生成单元、第一锁相环时钟重配单元、进帧存控制单元、第一出帧存控制单元和存储控制器,其中:

所述ADVB解析单元、所述进帧存控制单元和所述存储控制器依次信号连接,所述存储控制器用于与存储器信号连接,以通过所述ADVB解析单元将接收的ARINC818视频信号解析成RGB888数据,并将所述RGB888数据通过所述进帧存控制单元暂存至所述存储器;

所述ADVB解析单元、所述第一分辨率检测单元、所述第一锁相环时钟重配单元和所述存储控制器依次信号连接,以将所述ADVB解析单元解析的RGB888数据通过所述第一分辨率检测单元进行分辨率检测,并通过所述第一锁相环时钟重配单元为所述RGB888数据配置与分辨率对应的第一像素时钟后,将所述第一像素时钟发送至所述存储控制器;

所述存储控制器、所述第一VESA时序生成单元和所述第一锁相环时钟重配单元分别与所述第一出帧存控制单元信号连接,所述第一出帧存控制单元用于与视频输出接口芯片信号连接,以通过所述第一锁相环时钟重配单元将所述第一像素时钟发送至所述第一出帧存控制单元,在所述第一出帧存控制单元接收到所述存储器输出的RGB888数据时,通过所述第一VESA时序生成单元根据所述第一像素时钟将所述RGB888数据恢复为满足VESA标准的时序后,将所述RGB888数据从所述第一出帧存控制单元输出至所述视频输出接口芯片。

2.根据权利要求1所述的自适应分辨率的ARINC818总线仿真测试设备,其特征在于,所述ARINC818总线接收模块还包括PCIE DMA控制单元和PCIE控制器单元,所述存储控制器、PCIE DMA控制单元和PCIE控制器单元依次信号连接,所述ADVB解析单元与所述存储控制器信号连接,所述PCIE控制器单元用于与上位机信号连接,以将所述ADVB解析单元解析出的原始数据依次通过所述存储控制器、所述PCIE DMA控制单元和所述PCIE控制器单元传输至所述上位机。

3.根据权利要求2所述的自适应分辨率的ARINC818总线仿真测试设备,其特征在于,所述自适应分辨率的ARINC818总线仿真测试设备还包括第一控制寄存器单元,所述第一控制寄存器单元分别与所述ADVB解析单元和所述PCIE控制器单元信号连接。

4.根据权利要求2所述的自适应分辨率的ARINC818总线仿真测试设备,其特征在于,所述仿真测试设备还包括ARINC818总线发送模块,所述ARINC818总线发送模块包括第二锁相环时钟重配单元,第二VESA时序生成单元、第二出帧存控制单元、视频行缓存单元、ARINC818总线ADVB发送单元、所述PCIE DMA控制单元、所述PCIE控制器单元和所述存储控制器,其中:

所述存储控制器和所述第二出帧存控制单元信号连接,以用于将所述上位机输入的视频测试数据依次经所述PCIE控制器单元和所述PCIE DMA控制单元传输至所述第二出帧存控制单元;

所述第二锁相环时钟重配单元、第二VESA时序生成单元和第二出帧存控制单元、所述视频行缓存单元和所述ARINC818总线ADVB发送单元依次信号连接,所述ARINC818总线ADVB发送单元用于信号连接光电转换模块,以通过所述第二锁相环时钟重配单元为所述视频测试数据配置与分辨率对应的第二像素时钟,并将所述第二像素时钟分别发送至所述第二VESA时序生成单元和第二出帧存控制单元,在所述第二出帧存控制单元接收到所述上位机输出的所述视频测试数据时,所述第二VESA时序生成单元根据所述第二像素时钟将所述视频测试数据恢复为满足VESA标准的时序后,通过所述视频行缓存单元进行视频行缓存、通过所述ARINC818总线ADVB发送单元组成协议帧,并发送至光电转换模块。

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