[发明专利]三维存储器及其制备方法在审
申请号: | 202010517132.7 | 申请日: | 2020-06-09 |
公开(公告)号: | CN111769113A | 公开(公告)日: | 2020-10-13 |
发明(设计)人: | 张豪;郭海峰;艾义明 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11565 | 分类号: | H01L27/11565;H01L27/11568;H01L27/11582 |
代理公司: | 广州三环专利商标代理有限公司 44202 | 代理人: | 熊永强 |
地址: | 430074 湖北省武汉*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 三维 存储器 及其 制备 方法 | ||
1.一种三维存储器的制备方法,其特征在于,包括:
提供衬底,其中,所述衬底包括堆叠面;
自所述衬底的堆叠面在衬底中形成包括阻隔层和牺牲层的填充结构,其中,所述阻隔层围设在所述牺牲层的周边;
在所述衬底的堆叠面形成叠层结构;
形成贯穿所述叠层结构且暴露出所述牺牲层的沟道孔;
移除所述牺牲层,以使所述叠层结构和所述阻隔层配合形成与所述沟道孔连通的开槽;
形成贯穿所述叠层结构和所述阻隔层且暴露出所述衬底的栅缝隙,其中,所述栅缝隙与所述沟道孔间隔设置;以及,
形成位于所述开槽和所述沟道孔的沟道层以及位于所述栅缝隙的外延层,以使所述沟道层和所述外延层连接。
2.如权利要求1所述的三维存储器的制备方法,其特征在于,在所述移除所述牺牲层,以使所述叠层结构和所述阻隔层配合形成与所述沟道孔连通的开槽之后,以及,在所述形成贯穿所述叠层结构和所述阻隔层且暴露出所述衬底的栅缝隙之前,所述方法包括:
在所述沟道孔的侧壁和所述开槽的槽壁依次形成阻挡层、电荷捕获层、隧穿层以及第一沟道层,其中,所述开槽中位于所述叠层结构侧的第一沟道层与位于所述阻隔层侧的第一沟道层之间形成间隙。
3.如权利要求2所述的三维存储器的制备方法,其特征在于,所述形成位于所述开槽和所述沟道孔的沟道层,包括:
在所述开槽内沿所述第一沟道层形成充满所述间隙的第二沟道层,以使所述第二沟道层与所述第一沟道层连接形成沟道层。
4.如权利要求2所述的三维存储器的制备方法,其特征在于,在所述在所述沟道孔的侧壁和所述开槽的槽壁依次形成阻挡层、电荷捕获层、隧穿层以及第一沟道层之后,以及所述形成贯穿所述叠层结构和所述阻隔层且暴露出所述衬底的栅缝隙之前,所述方法包括:
在所述沟道孔内填充沟道氧化物。
5.如权利要求1所述的三维存储器的制备方法,其特征在于,所述在所述衬底中形成包括阻隔层和牺牲层的填充结构,包括:
自所述衬底的堆叠面在所述衬底中形成凹槽;
在所述凹槽内形成阻隔层;以及,
在所述阻隔层的表面形成覆盖所述阻隔层且填充所述凹槽的牺牲层。
6.如权利要求5所述的三维存储器的制备方法,其特征在于,所述在所述衬底中形成凹槽,包括:
在所述衬底的堆叠面形成硬掩膜层;
图案化所述硬掩膜层,形成硬掩膜图案;以及,
以所述硬掩膜图案为掩膜在所述衬底中形成凹槽。
7.如权利要求1所述的三维存储器的制备方法,其特征在于,所述牺牲层的厚度范围在100nm~200nm之间。
8.如权利要求1所述的三维存储器的制备方法,其特征在于,所述填充结构的顶面与所述衬底的堆叠面共面。
9.如权利要求1所述的三维存储器的制备方法,其特征在于,所述堆叠面的任意一边为第一边,所述顶面的任意一边为第二边,所述第一边的延伸方向和所述第二边的延伸方向相交。
10.一种三维存储器,其特征在于,包括采用如权利要求1-9任一项所述的三维存储器的制备方法制备。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的