[发明专利]一种多PCIE端口的MSI中断过滤装置有效

专利信息
申请号: 202010560215.4 申请日: 2020-06-18
公开(公告)号: CN111611185B 公开(公告)日: 2021-10-01
发明(设计)人: 刘威;龚锐;石伟;周宏伟;张剑锋;任巨;杨乾明;张见;王永文 申请(专利权)人: 中国人民解放军国防科技大学
主分类号: G06F13/34 分类号: G06F13/34;G06F13/366;G06F13/42;G06F13/38
代理公司: 湖南兆弘专利事务所(普通合伙) 43008 代理人: 谭武艺
地址: 410073 湖南*** 国省代码: 湖南;43
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摘要:
搜索关键词: 一种 pcie 端口 msi 中断 过滤 装置
【权利要求书】:

1.一种多PCIE端口的MSI中断过滤装置,其特征在于,包括维序模块单元和协议转换模块,所述维序模块单元包括对应每个PCIE端口的维序模块,所述维序模块包括从地址缓冲(11)、MSI地址域匹配逻辑(12)、边带缓冲(13)、主地址缓冲(14)、从数据缓冲(15)、MSI数据缓冲(16)、主数据缓冲(17)、数据选择器(18)、从响应缓冲(19)、MSI响应缓冲(20)、响应轮询控制模块(21)、响应选择器(22)、主响应缓冲(23)、突发队列控制模块(24)以及缓冲控制模块(25),所述从地址缓冲(11)的输出端分为两路且一路通过MSI地址域匹配逻辑(12)输出给主地址缓冲(14)、另一路通过边带缓冲(13)作为MSI数据缓冲(16)的一路输入,所述从数据缓冲(15)的输出端通过数据选择器(18)分为两路且一路作为MSI数据缓冲(16)的另一路输入、另一路作为主数据缓冲(17)的输入,所述从响应缓冲(19)、MSI响应缓冲(20)的输出端分别与响应选择器(22)的输入端相连,所述响应选择器(22)的输出端与主响应缓冲(23)相连,所述响应选择器(22)的控制端与响应轮询控制模块(21)相连,所述突发队列控制模块(24)以及缓冲控制模块(25)用于对所有缓冲和选择器进行控制,所述突发队列控制模块(24)记录每个MSI请求以及其之前的未响应的写请求个数,所述缓冲控制模块(25)利用这些记录的写请求个数来保证维序模块流出每个MSI请求之前所有的写请求都返回了响应;所述协议转换模块包括端口选择器(26)、AXI协议转换模块(27)以及多端口轮询控制模块(28),所述MSI数据缓冲(16)的输出端、端口选择器(26)、AXI协议转换模块(27)依次相连,所述端口选择器(27)的控制端与多端口轮询控制模块(28)相连,所述AXI协议转换模块(27)将PCIE拓扑节点的标号设备节点号DEVID作为新地址信息的AXI写请求。

2.根据权利要求1所述的多PCIE端口的MSI中断过滤装置,其特征在于,所述从地址缓冲(11)、边带缓冲(13)、主地址缓冲(14)、从数据缓冲(15)、MSI数据缓冲(16)、主数据缓冲(17)、从响应缓冲(19)、MSI响应缓冲(20)、主响应缓冲(23)均为同时钟域的先入先出存储单元,存储单元的位宽可配置,具有读写通道、空满和已存数目状态。

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