[发明专利]FPGA异构加速平台部分重置、系统、设备及介质在审

专利信息
申请号: 202010664249.8 申请日: 2020-07-10
公开(公告)号: CN111858461A 公开(公告)日: 2020-10-30
发明(设计)人: 王媛丽;王江为;任智新 申请(专利权)人: 浪潮电子信息产业股份有限公司
主分类号: G06F15/78 分类号: G06F15/78
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 刘晓菲
地址: 250101 山东*** 国省代码: 山东;37
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摘要:
搜索关键词: fpga 加速 平台 部分 重置 系统 设备 介质
【权利要求书】:

1.一种FPGA异构加速平台部分重置方法,其特征在于,包括:

通过目标FPGA对应的主机将目标比特文件下载到所述目标FPGA的控制单元中;

通过所述控制单元确定所述目标比特文件对应的待重置区域;

如果所述待重置区域为子动态区域,则利用所述目标比特文件对所述目标FPGA的动态区域中的目标子动态区域进行重置;

如果所述待重置区域为全部子动态区域,则利用所述目标比特文件对所述目标FPGA的全部子动态区域进行重置。

2.根据权利要求1所述的FPGA异构加速平台部分重置方法,其特征在于,所述通过目标FPGA对应的主机将目标比特文件下载到所述目标FPGA的控制单元中之前,还包括:

通过所述主机获取目标加速算法代码,并对所述目标加速算法代码进行编译,得到所述目标比特文件。

3.根据权利要求1或2所述的FPGA异构加速平台部分重置方法,其特征在于,所述通过目标FPGA对应的主机将目标比特文件下载到所述目标FPGA的控制单元中之前,还包括:

获取所述目标FPGA对应的区域部署信息;

根据所述区域部署信息将所述目标FPGA的内部逻辑划分为动态区域和静态区域;

根据所述区域部署信息将所述动态区域划分为多个子动态区域。

4.根据权利要求3所述的FPGA异构加速平台部分重置方法,其特征在于,所述根据所述区域部署信息将所述目标FPGA的内部逻辑划分为动态区域和静态区域,包括:

根据所述区域部署信息将所述目标FPGA中的接口逻辑划分为所述静态区域;

根据所述区域部署信息将所述目标FPGA中的加速算法划分为所述动态区域。

5.根据权利要求4所述的FPGA异构加速平台部分重置方法,其特征在于,所述获取所述目标FPGA对应的区域部署信息之前,还包括:

对所述目标FPGA进行整体编译,得到所述加速算法中各个加速单元的目标信息,其中,所述目标信息包括各个所述加速单元在所述目标FPGA上的位置信息和所占资源信息;

根据所述目标信息确定所述区域部署信息。

6.根据权利要求5所述的FPGA异构加速平台部分重置方法,其特征在于,所述根据所述区域部署信息将所述动态区域划分为多个子动态区域之后,还包括:

设置所述动态区域对应的第一加速算法版本号以及各个所述子动态区域对应的第二加速算法版本号,以便根据所述第一加速算法版本号以及所述第二加速算法版本号确定所述待重置区域。

7.根据权利要求6所述的FPGA异构加速平台部分重置方法,其特征在于,所述通过所述控制单元确定所述目标比特文件对应的待重置区域,包括:

通过所述控制单元确定所述目标比特文件对应的加速算法版本号;

根据所述目标比特文件对应的加速算法版本号确定所述待重置区域。

8.一种FPGA异构加速平台部分重置系统,其特征在于,包括:

目标FPGA对应的主机,用于将目标比特文件下载到所述目标FPGA的控制单元中;

所述控制单元,用于确定所述目标比特文件对应的待重置区域;

所述控制单元,用于在所述待重置区域为子动态区域时,则利用所述目标比特文件对所述目标FPGA的动态区域中的目标子动态区域进行重置;

所述控制单元,用于在所述待重置区域为全部子动态区域时,则利用所述目标比特文件对所述目标FPGA的全部子动态区域进行重置。

9.一种电子设备,其特征在于,包括:

存储器和处理器;

其中,所述存储器,用于存储计算机程序;

所述处理器,用于执行所述计算机程序,以实现权利要求1至7任一项所述的FPGA异构加速平台部分重置方法。

10.一种计算机可读存储介质,其特征在于,用于保存计算机程序,其中,所述计算机程序被处理器执行时实现如权利要求1至7任一项所述的FPGA异构加速平台部分重置方法。

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