[发明专利]错误检测在审
申请号: | 202010916167.8 | 申请日: | 2020-09-03 |
公开(公告)号: | CN112445639A | 公开(公告)日: | 2021-03-05 |
发明(设计)人: | F·罗曼;M·利萨特;P·阿努尔 | 申请(专利权)人: | 意法半导体(鲁塞)公司;意法半导体(ALPS)有限公司 |
主分类号: | G06F11/07 | 分类号: | G06F11/07;G06F11/10 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 董莘 |
地址: | 法国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 错误 检测 | ||
1.一种方法,包括通过以下步骤将数据写入存储器中:
将表示所述数据和纠错码或检错码的二进制字至少划分成第一部分和第二部分;以及
将所述第一部分写入在第一存储器电路中的逻辑地址处;以及
将所述第二部分写入在第二存储器电路中的所述逻辑地址处,其中所述第二存储器电路不同于所述第一存储器电路,并且所述第二存储器电路被配置为存储与所述第一存储器电路一样多的二进制字;
其中,所述纠错码或检错码取决于所述数据和所述逻辑地址两者。
2.根据权利要求1所述的方法,其中所述第一部分和所述第二部分各自具有相同的尺寸。
3.根据权利要求1所述的方法,其中所述二进制字是所述数据和所述纠错码或检错码的级联。
4.根据权利要求1所述的方法,其中所述数据和所述逻辑地址由单个第一处理器提供。
5.根据权利要求1所述的方法,其中所述数据和所述逻辑地址由至少一个第二处理器和第三处理器提供。
6.根据权利要求5所述的方法,其中将由所述第二处理器提供的所述数据与由所述第三处理器提供的所述数据进行比较,并且将由所述第二处理器提供的所述逻辑地址与由所述第三处理器提供的所述逻辑地址进行比较。
7.根据权利要求5所述的方法,其中所述第二处理器将所述逻辑地址提供给至少两个所述存储器电路中的一个存储器电路,并且所述第三处理器将所述逻辑地址提供给至少两个所述存储器电路中的另一个存储器电路。
8.根据权利要求5所述的方法,其中所述第二处理器将所述逻辑地址提供给至少两个所述存储器电路。
9.根据权利要求1所述的方法,其中所述第一存储器电路和所述第二存储器电路均具有相同的尺寸。
10.根据权利要求1所述的方法,其中至少两个所述存储器电路的内部控制信号被比较。
11.根据权利要求1所述的方法,还包括通过以下步骤从所述存储器读取所述数据:
从所述第一存储器电路读取在所述逻辑地址处的所述第一部分;并且
从所述第二存储器电路读取在所述逻辑地址处的所述第二部分。
12.根据权利要求11所述的方法,其中读取还包括:将分别从所述第一存储器电路和所述第二存储器电路读取的所述第一部分和所述第二部分进行级联,以形成读取的二进制字。
13.根据权利要求12所述的方法,通过从所述读取的二进制字去除所述纠错码或检错码来获得所述数据。
14.根据权利要求13所述的方法,还包括:通过基于自所述存储器读取的所述数据再次计算所述纠错码或检错码,来检测在所述数据中的错误。
15.根据权利要求14所述的方法,还包括:验证所述纠错码或检错码。
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